Freescale Semiconductor, Inc.
Table of Contents
3.5.9
Bit Test and Branch . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .39
3.5.10 Inherent . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .40
3.6
Resets. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .40
Power-On Reset (POR) . . . . . . . . . . . . . . . . . . . . . . . . . . . .40
RESET Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .40
Computer Operating Properly (COP) Reset. . . . . . . . . . . . .40
Illegal Address Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .41
3.6.1
3.6.2
3.6.3
3.6.4
3.7
Interrupts. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .41
Hardware Controlled Interrupt Sequence. . . . . . . . . . . . . . .42
Software Interrupt (SWI). . . . . . . . . . . . . . . . . . . . . . . . . . . .44
External Interrupt . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .45
Timer Interrupt . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .45
Custom Peirodic Interrupt (CPI) . . . . . . . . . . . . . . . . . . . . . .45
3.7.1
3.7.2
3.7.3
3.7.4
3.7.5
3.8
Low-Power Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .46
STOP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .46
WAIT . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .46
Data-Retention Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .47
3.8.1
3.8.2
3.8.3
Section 4. Input/Output Ports
4.1
4.2
4.3
4.4
4.5
4.6
Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .49
Introduction. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .49
Port A . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .49
Port B . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .50
Port C . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .50
Input/Output Programmingf . . . . . . . . . . . . . . . . . . . . . . . . . . .50
Section 5. Memory
5.1
5.2
5.3
5.4
Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53
Introduction. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53
ROM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53
RAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53
MC68HC05E1 — Revision 2.0
General Release Specification
Table of Contents
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