5V49EE901PGGI

更新时间： 2024-02-14 02:35:40

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EEPROM PROGRAMMABLE CLOCK GENERATOR

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5V49EE901PGGI 数据手册

IDT5V49EE901

EEPROM PROGRAMMABLE CLOCK GENERATOR

CLOCK SYNTHESIZER

Default

Bit #

Addr

Description

Hex

Value

PM1_CFG0

PM1_CFG1

PM1_CFG2

PM1_CFG3

PM1_CFG4

PM1_CFG5

PM2_CFG4

PM2_CFG5

PM2_CFG0

PM2_CFG1

PM2_CFG2

PM2_CFG3

PM3_CFG0

PM3_CFG1

PM3_CFG2

PM3_CFG3

PM3_CFG4

PM3_CFG5

PM4_CFG4

PM4_CFG5

PM4_CFG0

PM4_CFG1

PM4_CFG2

PM4_CFG3

PM5_CFG0

PM5_CFG1

PM5_CFG2

PM5_CFG3

PM5_CFG4

PM5_CFG5

PM6_CFG4

PM6_CFG5

PM6_CFG0

PM6_CFG1

PM6_CFG2

PM6_CFG3

Q1[6:0]_CFG0

Q1[6:0]_CFG1

Q1[6:0]_CFG2

Q1[6:0]_CFG3

Q1[6:0]_CFG4

Q1[6:0]_CFG5

Q2[6:0]_CFG4

Q2[6:0]_CFG5

Q2[6:0]_CFG0

Q2[6:0]_CFG1

Q2[6:0]_CFG2

Q2[6:0]_CFG3

Q3[6:0]_CFG0

Q3[6:0]_CFG1

Q3[6:0]_CFG2

Q3[6:0]_CFG3

Q3[6:0]_CFG4

Q3[6:0]_CFG5

Q4[6:0]_CFG4

Q4[6:0]_CFG5

Q4[6:0]_CFG0

Q4[6:0]_CFG1

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Q5[6:0]_CFG1

Q5[6:0]_CFG2

Q5[6:0]_CFG3

Q5[6:0]_CFG4

Q5[6:0]_CFG5

Q6[6:0]_CFG4

Q6[6:0]_CFG5

Q6[6:0]_CFG0

Q6[6:0]_CFG1

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Q6[6:0]_CFG3

0x88

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0x8A

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0x90

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0x92

0x93

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0x9A

0x9B

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0x9E

0x9F

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0xB0

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0xB3

0xB4

0xB5

0xB6

0xB7

0xB8

0xB9

0xBA

Output Divides

for Q<>111111,

PM=0 - Divide by 2

PM=1, (Q+2)*2

for Q=1111111

PM=0, disable the output divider

PM=1, bypass the output divide,

(divide by 1)

TSSC[3:0]_CFG0

TSSC[3:0]_CFG1

TSSC[3:0]_CFG2

TSSC[3:0]_CFG3

TSSC[3:0]_CFG4

TSSC[3:0]_CFG5

NSSC[3:0]_CFG0

NSSC[3:0]_CFG1

NSSC[3:0]_CFG2

NSSC[3:0]_CFG3

NSSC[3:0]_CFG4

NSSC[3:0]_CFG5

PLL0 Spread Spectrum Control

DITH_CFG4

DITH_CFG5

DITH_CFG0

DITH_CFG1

DITH_CFG2

DITH_CFG3

X2_CFG4

SSOFFSET[5:0]_CFG4

SSOFFSET[5:0]_CFG5

SSOFFSET[5:0]_CFG0

SSOFFSET[5:0]_CFG1

SSOFFSET[5:0]_CFG2

SSOFFSET[5:0]_CFG3

X2_CFG5

X2_CFG0

X2_CFG1

X2_CFG2

X2_CFG3

SD1[3:0]_CFG0

SD0[3:0]_CFG0

SD1[3:0]_CFG1

SD1[3:0]_CFG2

SD0[3:0]_CFG1

SD0[3:0]_CFG2

IDT® EEPROM PROGRAMMABLE CLOCK GENERATOR

IDT5V49EE901

REV J 022310

1...26 27 282930 31 32...35

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