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49FCT805

更新时间: 2024-01-09 20:56:22
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艾迪悌 - IDT 时钟驱动器
页数 文件大小 规格书
7页 130K
描述
FAST CMOS BUFFER/CLOCK DRIVER

49FCT805 技术参数

是否无铅: 不含铅是否Rohs认证: 符合
生命周期:Obsolete零件包装代码:SOIC
包装说明:SOP, SOP20,.4针数:20
Reach Compliance Code:compliantECCN代码:EAR99
HTS代码:8542.39.00.01风险等级:5.61
Samacsys Description:SOIC 300 MIL系列:FCT
输入调节:STANDARDJESD-30 代码:R-PDSO-G20
JESD-609代码:e3最大I(ol):0.064 A
湿度敏感等级:1功能数量:2
反相输出次数:端子数量:20
实输出次数:5最高工作温度:85 °C
最低工作温度:-40 °C输出特性:3-STATE
封装主体材料:PLASTIC/EPOXY封装代码:SOP
封装等效代码:SOP20,.4封装形状:RECTANGULAR
封装形式:SMALL OUTLINE峰值回流温度(摄氏度):260
电源:5 VProp。Delay @ Nom-Sup:5.6 ns
传播延迟(tpd):5.6 ns认证状态:Not Qualified
Same Edge Skew-Max(tskwd):0.7 ns子类别:Clock Drivers
最大供电电压 (Vsup):5.25 V最小供电电压 (Vsup):4.75 V
标称供电电压 (Vsup):5 V表面贴装:YES
技术:CMOS温度等级:INDUSTRIAL
端子面层:Matte Tin (Sn) - annealed端子形式:GULL WING
端子节距:1.27 mm端子位置:DUAL
处于峰值回流温度下的最长时间:30Base Number Matches:1

49FCT805 数据手册

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IDT49FCT805/806/A  
FAST CMOS BUFFER/CLOCK DRIVER  
MILITARY AND COMMERCIAL TEMPERATURE RANGES  
TEST CIRCUITS AND WAVEFORMS  
TEST CIRCUITS FOR ALL OUTPUTS  
ENABLE AND DISABLE TIME  
SWITCH POSITION  
VCC  
7.0V  
Test  
Disable LOW  
Enable LOW  
Switch  
Closed  
500  
V OUT  
VIN  
Disable HIGH  
Enable HIGH  
DEFINITIONS:  
CL = Load capacitance: includes jig and probe capacitance.  
RT = Termination resistance: should be equal to ZOUT of the Pulse  
Open  
Pulse  
Generator  
D.U.T.  
2574 lnk 11  
50pF  
C L  
500Ω  
R T  
Generator.  
2574 drw 07  
PACKAGE DELAY  
OUTPUT SKEW - tSK(o)  
3V  
3V  
1.5V  
0V  
1.5V  
0V  
INPUT  
t
PLH1  
tPHL1  
INPUT  
VOH  
tPLH  
tPHL  
1.5V  
V
OH  
V
OL  
OUTPUT 1  
OUTPUT 2  
2.0V  
t
SK(o)  
tSK(o)  
1.5V  
VOH  
0.8V  
VOL  
1.5V  
OUTPUT  
VOL  
tF  
t
PLH2  
t
R
tPHL2  
t
SK(o) = |tPLH2 -  
tPLH1  
|
or |tPHL2 -  
tPHL1  
|
2574 drw 08  
2574 drw 09  
PACKAGE SKEW - tSK(t)  
PULSE SKEW - tSK(p)  
3V  
1.5V  
0V  
3V  
INPUT  
1.5V  
0V  
t
PHL1  
tPLH1  
INPUT  
VOH  
t
PHL  
1.5V  
t
PLH  
V
OH  
VOL  
PACKAGE 1 OUTPUT  
PACKAGE 2 OUTPUT  
1.5V  
V
t
SK(t)  
t
SK(t)  
VOH  
OL  
OUTPUT  
1.5V  
VOL  
t
SK(p) = |tPHL - tPLH|  
t
PLH2  
t
PHL2  
2574 drw 10  
t
SK(t) = |tPLH2 -  
tPLH1  
|
or |tPHL2 -  
t
PHL1  
|
Package 1 and Package 2 are same device type and speed grade  
2574 drw 11  
ENABLE AND DISABLE TIMES  
ENABLE  
DISABLE  
3V  
CONTROL  
INPUT  
1.5V  
0V  
t
PZL  
t PLZ  
3.5V  
1.5V  
3.5V  
VOL  
OUTPUT  
NORMALLY  
LOW  
SWITCH  
CLOSED  
0.3V  
t PHZ  
t
PZH  
OUTPUT  
NORMALLY  
HIGH  
0.3V VOH  
0V  
SWITCH  
OPEN  
1.5V  
0V  
2574 drw 12  
NOTES:  
1. Diagram shown for input Control Enable-LOW and input Control  
Disable-HIGH  
2. Pulse Generator for All Pulses: f 1.0MHz; tF 2.5ns; tR 2.5ns  
9.1  
6

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