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10AX032H3F34E2SG

更新时间： 2024-02-24 19:48:27

品牌	Logo	应用领域
英特尔 - INTEL		栅可编程逻辑
页数	文件大小	规格书
110页	1391K
描述
Field Programmable Gate Array, 320000-Cell, CMOS, PBGA1152, 35 X 35 MM, ROHS COMPLIANT, FBGA-1152

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10AX032H3F34E2SG 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	BGA, BGA1152,34X34,40	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.32
JESD-30 代码：	S-PBGA-B1152	长度：	35 mm
输入次数：	384	逻辑单元数量：	320000
输出次数：	384	端子数量：	1152
最高工作温度：	100 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	BGA
封装等效代码：	BGA1152,34X34,40	封装形状：	SQUARE
封装形式：	GRID ARRAY	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	0.9 V	可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY
认证状态：	Not Qualified	座面最大高度：	3.65 mm
子类别：	Field Programmable Gate Arrays	最大供电电压：	0.93 V
最小供电电压：	0.87 V	标称供电电压：	0.9 V
表面贴装：	YES	技术：	CMOS
温度等级：	OTHER	端子形式：	BALL
端子节距：	1 mm	端子位置：	BOTTOM
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	35 mm
Base Number Matches：	1

10AX032H3F34E2SG 数据手册

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A10-DATASHEET

2015.12.31

105

Document Revision History

Date

Version

Changes

•

Updated the AS Timing Parameters for AS ×1 and AS ×4 Configurations in Arria 10 Devices table as

follows:

•

Changed the symbol for data hold time from t_Hto t_DH

Updated the minimum value for t_SUfrom 0 ns to 1 ns.

Updated the minimum value for t_DHfrom 2.5 ns to 1.5 ns.

•

Added a note to the DCLK Frequency Specification in the AS Configuration Scheme table. Note: You can

only set 12.5, 25, 50, and 100 MHz in the Quartus Prime software.

Added a note to the Initialization Clock Source Option and the Maximum Frequency for Arria 10 Devices.

Note: If you use the CLKUSRpin for AS and transceiver calibration simultaneously, the only allowed

frequency is 100 MHz.

•

Changed Arria 10 GS to Arria 10 SX in Uncompressed .rbf Sizes and Minimum Configuration Time

Estimation tables.

•

Added IO_IN_DLY_CHN and IO_OUT_DLY_CHN in the IOE Programmable Delay table.

Changed the Min/Typ/Max description for the V_ICM(AC coupled) parameter in the "Reference Clock

Specifications" table.

•

Changed the Min/Typ/Max values in the "Transceiver Power Supply Operating Conditions for Arria 10 GX/

SX Devices" table.

Changed the Min/Typ/Max values in the "Transceiver Power Supply Operating Conditions for Arria 10 GT

Devices" table.

Added a footnote to the maximum data rate for GT channels in the "Transceiver Performance for GT

Devices" section.

Made the following changes to the "Transceiver Performance for Arria 10 GX/SX Devices" section.

•

Changed the maximum data rate condition for chip-to-chip and backplane in the "Transmitter and

Receiver Data Rate Performance" table.

•

Added TX minimum data rate to the "Transmitter and Receiver Data Rate Performance" table.

Changed the minimum frequency in the "ATX PLL Performance" table.

Changed the minimum frequency in the "Fractional PLL Performance" table.

Changed the minimum and maximum frequency in the "CMU PLL Performance" table.

Arria 10 Device Datasheet

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型号	品牌	描述	获取价格	数据表
10AX032H4F34E3SG	INTEL	Field Programmable Gate Array, 320000-Cell, CMOS, PBGA1152, 35 X 35 MM, ROHS COMPLIANT, FB	获取价格
10AX032H4F35I3SG	INTEL	Field Programmable Gate Array, 320000-Cell, CMOS, PBGA1152, 35 X 35 MM, ROHS COMPLIANT, FB	获取价格
10AX057H2F34I2SG	INTEL	Field Programmable Gate Array, 570000-Cell, CMOS, PBGA1152, 35 X 35 MM, ROHS COMPLIANT, FB	获取价格
10AX057H3F34I2SG	INTEL	Field Programmable Gate Array, 570000-Cell, CMOS, PBGA1152, 35 X 35 MM, ROHS COMPLIANT, FB	获取价格
10AX057H4F34E3SG	INTEL	Field Programmable Gate Array, 570000-Cell, CMOS, PBGA1152, 35 X 35 MM, ROHS COMPLIANT, FB	获取价格
10AX057H4F34I3LG	INTEL	Field Programmable Gate Array, 570000-Cell, CMOS, PBGA1152, 35 X 35 MM, ROHS COMPLIANT, FB	获取价格

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