100351SC

更新时间： 2024-01-06 21:30:58

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飞兆/仙童 - FAIRCHILD		触发器锁存器逻辑集成电路光电二极管
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9页	96K
描述
Low Power Hex D-Type Flip-Flop

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100351SC 技术参数

生命周期：	Contact Manufacturer	包装说明：	QFF,
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.59	其他特性：	WITH DUAL CLOCK
系列：	100K	JESD-30 代码：	S-GQFP-F24
长度：	9.398 mm	逻辑集成电路类型：	D FLIP-FLOP
位数：	6	功能数量：	1
端子数量：	24	最高工作温度：	125 °C
最低工作温度：	-55 °C	输出特性：	OPEN-EMITTER
输出极性：	COMPLEMENTARY	封装主体材料：	CERAMIC, GLASS-SEALED
封装代码：	QFF	封装形状：	SQUARE
封装形式：	FLATPACK	传播延迟（tpd）：	2.2 ns
筛选级别：	MIL-STD-883 Class B	座面最大高度：	2.159 mm
表面贴装：	YES	技术：	ECL
温度等级：	MILITARY	端子形式：	FLAT
端子节距：	1.27 mm	端子位置：	QUAD
触发器类型：	POSITIVE EDGE	宽度：	9.398 mm
最小 fmax：	375 MHz	Base Number Matches：	1

100351SC 数据手册

Commercial Version (Continued)

SOIC and PLCC AC Electrical Characteristics

_EE= −4.2V to −5.7V, V_CC= V_CCA= GND

Symbol Parameter

Toggle Frequency

_C= 0°C

_C= +25°C

T_C= +85°C

Units

MHz

Conditions

Figures 2, 3

Figures 1, 3

Min

Max

Min

Max

Min

Max

f_MAX

t_PLH

t_PHL

t_PLH

t_PHL

t_TLH

t_THL

t_S

375

Propagation Delay

CP_a, CP_bto Output

Propagation Delay

MR to Output

0.80

1.80

2.10

1.70

0.80

1.10

0.45

1.80

2.10

1.60

0.90

1.20

0.45

1.90

2.20

1.70

1.10

0.45

Figures 1, 4

Figures 1, 3

Transition Time

20% to 80%, 80% to 20%

Setup Time

D₀–D₅

0.30

1.50

0.30

1.50

0.30

1.50

Figure 5

Figure 4

MR (Release Time)

Hold Time

t_H

0.80

2.00

0.80

2.00

0.80

2.00

Figure 5

D₀–D₅

t_PW(H)

Pulse Width HIGH

CP_a, CP_b, MR

Figures 3, 4

t_OSHL

Maximum Skew Common Edge

Output-to-Output Variation

Clock to Output Path

Maximum Skew Common Edge

Output-to-Output Variation

Clock to Output Path

Maximum Skew Opposite Edge

Output-to-Output Variation

Clock to Output Path

Maximum Skew

PLCC only

(Note 4)

220

210

240

230

220

210

240

230

220

210

240

230

t_OSLH

t_OST

t_PS

PLCC only

(Note 4)

PLCC only

(Note 4)

PLCC only

(Note 4)

Pin (Signal) Transition Variation

Clock to Output Path

Note 4: Output-to-Output Skew is defined as the absolute value of the difference between the actual propagation delay for any outputs within the same pack-

aged device. The specifications apply to any outputs switching in the same direction either HIGH-to-LOW (t_OSHL), or LOW-to-HIGH (t_OSLH), or in opposite

directions both HL and LH (t_OST). Parameters t_OSTand t_PSguaranteed by design.

www.fairchildsemi.com

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