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XC6124F647EL PDF预览

XC6124F647EL

更新时间： 2024-01-08 20:17:53
品牌 Logo 应用领域
特瑞仕 - TOREX /
页数 文件大小 规格书
23页 426K
描述
Voltage Detector with Watchdog Function and ON/OFF Control (VDF=1.6V~5.0V)

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XC6124F647EL 技术参数

是否Rohs认证： 符合生命周期：Active
包装说明：LSSOP, TSOP5/6,.11,37Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.15其他特性：DETECT THRESHOLD VOLTAGE IS 4.7V
可调阈值：NO模拟集成电路 - 其他类型：POWER SUPPLY MANAGEMENT CIRCUIT
JESD-30 代码：R-PDSO-G5JESD-609代码：e3
长度：2.9 mm湿度敏感等级：1
信道数量：1功能数量：1
端子数量：5最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：LSSOP封装等效代码：TSOP5/6,.11,37
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, LOW PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260电源：1/6 V
认证状态：Not Qualified座面最大高度：1.3 mm
子类别：Power Management Circuits最大供电电流 (Isup)：0.018 mA
最大供电电压 (Vsup)：6 V最小供电电压 (Vsup)：1 V
标称供电电压 (Vsup)：2 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin (Sn)端子形式：GULL WING
端子节距：0.95 mm端子位置：DUAL
处于峰值回流温度下的最长时间：10宽度：1.6 mm
Base Number Matches：1

XC6124F647EL 数据手册

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XC6121/XC6122/XC6123/XC6124  
Series  
Ta = 25 OC  
■ELECTRICAL CHARACTERISTICS  
PARAMETER  
SYMBOL  
CONDITIONS  
MIN.  
TYP.  
VDFL(T)  
VDFL  
MAX.  
UNITS CIRCUIT  
VDFL(T)  
× 0.98  
VDFL  
VDFL(T)  
× 1.02  
VDFL  
Detect Voltage  
VDFL  
V
V
①
①
EN=VSS,ENB=VIN  
Hysteresis Width  
VHYS  
× 0.02 × 0.05 × 0.08  
VIN=VDFL(T)×0.9V  
-
5
11  
the WD Pin:  
OPEN  
Supply Current (*1)  
Operating Voltage  
ISS  
μA  
②
①
VIN=VDFL(T)×1.1V  
VIN=6.0V  
-
10  
16  
-
12  
-
0.5  
18  
6.0  
-
VIN  
1.0  
0.15  
V
VIN=1.0V  
VIN=2.0V (VDFL(T)> 2.0V)  
VIN=3.0V (VDFL(T) >3.0V)  
VIN=4.0V (VDFL(T) >4.0V)  
2.0  
3.0  
3.5  
2.5  
3.5  
4.0  
-
-
-
N-ch.  
VDS = 0.5V  
Output Current  
IRBOUT  
mA  
③
①
Temperature  
Characteristics  
△VDFL /  
△Topr・VDFL  
-40OC < Topr < 85 OC  
-
+100  
-
ppm/ OC  
2.00  
37  
3.13  
50  
5.00  
63  
Time until VIN is increased from  
1.0V to 2.0V  
Release Delay Time  
(VDFL<1.8V)  
TDR  
TDR  
ms  
ms  
④
④
75  
100  
200  
400  
3.13  
50  
125  
250  
500  
5.00  
63  
and attains to the release time level,  
and the Reset output pin releases.  
150  
300  
2.00  
37  
Time until VIN is increased from  
1.0V to (VDFL x 1.1V)  
and attains to the release time level,  
and the Reset output pin releases.  
Release Delay Time  
(VDFL>1.9V)  
75  
100  
200  
400  
125  
250  
500  
150  
300  
Time until VIN is decreased from 6.0V to  
1.0V and attains to the detect voltage  
level, and the Reset output pin detects  
while the WD pin left open.  
Detect Delay Time  
TDF  
-
5.5  
33  
μs  
④
③
VDFL  
Leak Current  
ILEAK  
VIN=6.0V, RESETB=6.0V  
-
0.01  
0.1  
μA  
37  
75  
50  
100  
200  
400  
800  
1600  
50  
63  
125  
250  
500  
1000  
2000  
63  
Time until VIN increases form  
1.0V to 2.0V and  
the Reset output pin is released to go into  
Watchdog  
Timeout Period  
(VDFL<1.8V)  
150  
300  
600  
1200  
37  
TWD  
ms  
ms  
⑤
⑤
the detection state. (WD=VSS)  
75  
100  
200  
400  
800  
1600  
125  
250  
500  
1000  
2000  
Time until VIN increases from  
1.0V to (VDFLx1.1V)  
and the Reset output pin is released to go  
Watchdog  
Timeout Period  
(VDFL>1.9V)  
150  
300  
600  
1200  
TWD  
into the detection state. (WD=VSS)  
7/23  
1...45678910...23

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