UPD3768D

更新时间： 2024-02-14 10:36:56

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日电电子 - NEC		传感器图像传感器
页数	文件大小	规格书
24页	185K
描述
7500 PIXELS x 3 COLOR CCD LINEAR IMAGE SENSOR

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UPD3768D 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
包装说明：	CERAMIC, DIP-36	Reach Compliance Code：	compliant
风险等级：	5.84	Is Samacsys：	N
主体宽度：	14.66 mm	主体高度：	5 mm
主体长度或直径：	94 mm	数据速率：	44 Mbps
水平像素：	7500	JESD-609代码：	e6/e4
安装特点：	THROUGH HOLE MOUNT	最高工作温度：	60 °C
最低工作温度：	-25 °C	输出范围：	1.50-2V
输出类型：	ANALOG VOLTAGE	封装形状/形式：	RECTANGULAR
传感器/换能器类型：	IMAGE SENSOR,CCD	光谱响应 (nm)：	400-700
最大供电电压：	10.5 V	最小供电电压：	9.5 V
表面贴装：	NO	端子面层：	TIN BISMUTH/NICKEL PALLADIUM GOLD
端接类型：	SOLDER	垂直像素：	7500
Base Number Matches：	1

UPD3768D 数据手册

µ PD3768

ABSOLUTE MAXIMUM RATINGS (T^A= +25°C)

Parameter

Output drain voltage

Symbol

Ratings

−0.3 to +12

−0.3 to +8

−25 to +60

−40 to +100

Unit

V^OD

Shift register clock voltage

Last gate shift register clock voltage

Reset gate clock voltage

V^φ¹, V^φ²

V^φ^2L

V^φ^R

Clamp clock voltage

V^φ^CP

Transfer gate clock voltage

Operating ambient temperature ^Note

Storage temperature

V^φ^TG1to V^φ^TG3

T^A

°C

T^stg

Note Use at the condition without dew condensation.

Caution Product quality may suffer if the absolute maximum rating is exceeded even momentarily for any

parameter. That is, the absolute maximum ratings are rated values at which the product is on the

verge of suffering physical damage, and therefore the product must be used under conditions that

ensure that the absolute maximum ratings are not exceeded.

RECOMMENDED OPERATING CONDITIONS (T^A= +25°C)

Parameter

Output drain voltage

Symbol

Min.

9.5

Typ.

10.0

5.0

Max.

10.5

5.5

Unit

V^OD

Shift register clock high level

Shift register clock low level

Last gate shift register clock high level

Last gate shift register clock low level

Reset gate clock high level

Reset gate clock low level

Clamp clock high level

V^φ^1H, V^φ^2H

V^φ^1L, V^φ^2L

V^φ^2LH

4.5

−0.3

4.5

+0.5

5.5

5.0

V^φ^2LL

−0.3

4.5

+0.5

5.5

V^φ^RH

5.0

V^φ^RL

−0.3

4.5

+0.5

5.5

V^φ^CPH

5.0

Clamp clock low level

V^φ^CPL

−0.3

4.5

+0.5

Note

V^φ^1H

Note

V^φ^1H

Transfer gate clock high level

Transfer gate clock low level

Data rate

V^φ^TG1Hto V^φ^TG3H

V^φ^TG1Lto V^φ^TG3L

2f^φ^R

−0.3

+0.5

MHz

Note When Transfer gate clock high level (Vφ ^TG1Hto Vφ ^TG3H) is higher than Shift register clock high level (Vφ ^1H),

Image lag can increase.

Data Sheet S15418EJ2V0DS

1 2 345 6 7...24

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与UPD3768D相关器件

型号	品牌	描述	获取价格	数据表
UPD3768D-AZ	NEC	CCD Sensor, 7500 Horiz pixels, 7500 Vert pixels, 1.50-2V, Rectangular, Through Hole Mount,	获取价格
UPD3777	NEC	5400 PIXELS x 3 COLOR CCD LINEAR IMAGE SENSOR	获取价格
UPD3777CY	NEC	5400 PIXELS x 3 COLOR CCD LINEAR IMAGE SENSOR	获取价格
UPD3778	NEC	10600 PIXELS x 3 COLOR CCD LINEAR IMAGE SENSOR	获取价格
UPD3778CY	NEC	10600 PIXELS x 3 COLOR CCD LINEAR IMAGE SENSOR	获取价格
UPD3788	NEC	7300 PIXELS x 3 COLOR CCD LINEAR IMAGE SENSOR	获取价格