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Datasheet > 微控制器和处理器 > 数字信号处理器> TMS320C52PZ80
TMS320C52PZ80 PDF预览

TMS320C52PZ80

更新时间： 2024-01-30 05:45:02
品牌 Logo 应用领域
德州仪器 - TI 微控制器和处理器外围集成电路数字信号处理器时钟
页数 文件大小 规格书
91页 1303K
描述
DIGITAL SIGNAL PROCESSORS

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TMS320C52PZ80 技术参数

是否无铅：含铅是否Rohs认证：不符合
生命周期：Obsolete零件包装代码：QFP
包装说明：PLASTIC, LQFP-100针数：100
Reach Compliance Code：not_compliantECCN代码：3A001.A.3
HTS代码：8542.31.00.01风险等级：5.88
Is Samacsys：N地址总线宽度：16
桶式移位器：YES位大小：16
边界扫描：YES最大时钟频率：80 MHz
外部数据总线宽度：16格式：FIXED POINT
内部总线架构：MULTIPLEJESD-30 代码：S-PQFP-G100
长度：14 mm低功率模式：YES
端子数量：100最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：LFQFP封装等效代码：QFP100,.63SQ,20
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE, FINE PITCH
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
认证状态：Not QualifiedRAM（字数）：1056
座面最大高度：1.6 mm子类别：Digital Signal Processors
最大压摆率：157 mA最大供电电压：5.25 V
最小供电电压：4.75 V标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：14 mm
uPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHERBase Number Matches：1

TMS320C52PZ80 数据手册

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TMS320C5x, TMS320LC5x  
DIGITAL SIGNAL PROCESSORS  
SPRS030A – APRIL 1995 – REVISED APRIL 1996  
Pin Functions for the TMS320LC57 in the PBK Package  
SIGNAL  
TYPE  
DESCRIPTION  
PARALLEL INTERFACE BUS  
A0–A15  
I/O/Z  
I/O/Z  
O/Z  
16-bit external address bus (MSB: A15, LSB: A0)  
16-bit external data bus (MSB: D15, LSB: D0)  
D0–D15  
PS, DS, IS  
STRB  
Program, data, and I/O space select outputs, respectively  
Timing strobe for external cycles and external DMA  
Read/write select for external cycles and external DMA  
Read and write strobes, respectively, for external cycles  
External bus ready/wait-state control input  
Bus request. Arbitrates global memory and external DMA  
SYSTEM INTERFACE/CONTROL SIGNALS  
Reset. Initializes device and sets PC to zero  
Microprocessor/microcomputer mode select. Enables internal ROM  
Puts parallel I/F bus in high-impedance state after current cycle  
Hold acknowledge. Indicates external bus in hold state  
External flag output. Set/cleared through software  
I/O branch input. Implements conditional branches  
Timer output signal. Indicates output of internal timer  
Instruction acquisition signal  
I/O/Z  
I/O/Z  
O/Z  
R/W  
RD, WE  
READY  
BR  
I
I/O/Z  
RS  
I
MP/MC  
HOLD  
HOLDA  
XF  
I
I
O/Z  
O/Z  
I
BIO  
TOUT  
IAQ  
O/Z  
O/Z  
I
INT1–INT4  
NMI  
External interrupt inputs  
I
Nonmaskable external interrupt  
SERIAL PORT INTERFACE  
DR  
I
O/Z  
I
Serial receive-data input  
DX  
Serial transmit-data output. In high-impedance state when not transmitting  
Serial receive-data clock input  
CLKR  
CLKX  
FSR  
FSX  
I/O/Z  
I
Serial transmit-data clock. Internal or external source  
Serial receive-frame-synchronization input  
Serial transmit-frame-synchronization signal. Internal or external source  
HOST PORT INTERFACE (HPI)  
I/O/Z  
HCNTL0  
HCNTL1  
HINT  
I
HPI mode control 1  
I
HPI mode control 2  
O/Z  
Host interrupt  
HDS1  
I
HPI data strobe 1  
HDS2  
I
HPI data strobe 2  
HR/W  
HAS  
I
HPI read/write strobe  
I
HPI address strobe  
HRDY  
HCS  
O/Z  
HPI ready signal  
I
HPI chip select  
HBIL  
I
HPI byte identification input  
HD0–HD7  
LEGEND:  
I/O/Z  
HPI data bus  
I
= Input  
O = Output  
Z = High impedance  
7
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251–1443  
1...45678910...91

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