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Datasheet > 驱动程序和接口 > 显示驱动器> STV7697A
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STV7697A

更新时间： 2024-01-19 00:23:44
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 驱动器
页数 文件大小 规格书
15页 112K
描述
PLASMA DISPLAY PANEL SCAN DRIVER

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STV7697A 技术参数

生命周期：Obsolete零件包装代码：DIE
包装说明：DIE,针数：97
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.84
Is Samacsys：N数据输入模式：SERIAL
接口集成电路类型：DC PLASMA DISPLAY DRIVERJESD-30 代码：R-XUUC-N97
复用显示功能：NO功能数量：1
区段数：64端子数量：97
最高工作温度：85 °C最低工作温度：-20 °C
封装主体材料：UNSPECIFIED封装代码：DIE
封装形状：RECTANGULAR封装形式：UNCASED CHIP
认证状态：Not Qualified最大供电电压：5.5 V
最小供电电压：4.5 V标称供电电压：5 V
电源电压1-最大：160 V电源电压1-分钟：15 V
电源电压1-Nom：160 V表面贴装：YES
技术：BCD温度等级：OTHER
端子形式：NO LEAD端子位置：UPPER
最小 fmax：20 MHzBase Number Matches：1

STV7697A 数据手册

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STV7697A  
BLOCK DIAGRAM  
VCC  
93  
89  
87  
91  
CLK  
F/R  
64-BITSHIFT REGISTER  
LATCH  
P1  
P64  
S64  
SIN (SOUT)  
SOUT(SIN)  
VSSSUB  
Pins 38-43  
S1  
92  
86  
STB  
BLK  
Q1Q2  
Q63Q64  
VSSLOG  
Pins 39-40-42-94  
VCC  
VCC  
Pins 41-90  
VCC  
85  
POL  
VSSP  
Pins 34-35-36-45-46  
47-82-83-98-99  
VPP  
Pins 33-37-44-48  
81-84-97-100  
VSSP  
VPP  
VSSP  
VPP  
STV7697A  
80  
OUT1  
1
OUT64  
CIRCUIT DESCRIPTION  
The STV7697A contains all the logic and the pow-  
er circuits necessary to drive rows of a Plasma  
Display Panel (P. D. P.). The state of the displayed  
line is loaded into the shift register. Data are shift-  
ed at each low to high transition of the (CLK) shift  
clock. After 64 shifts the first bit is available at the  
serial output. This output can be used to cascade  
several drivers to perform any vertical resolution.  
(POL) at high level and forced to low level with  
POL at low level.  
The level of the power output is inverted when the  
polarity command (POL) is pulled high.  
Sustain current must not be sunk in the power out-  
put to V when the power supply is applied.  
PP  
V
and V  
must be connected as close  
SSLOG  
SSSUB  
as possible to the logical reference ground of the  
application.  
The forward / reverse (F/R) input is used to select  
the direction of the shift register, data input/output  
status is set according to the selected direction.  
SIN, CLK, STB inputs  
Shift Register Truth Table  
are Smith trigger inputs . If not used on the appli-  
cation, F/R, BLK, POL logical inputs are internaly  
pulled to level ”1”. The maximum frequency of the  
shift clock is 20 MHz.  
Shift Register  
Input  
Input/Output  
Function  
SIN SOUT Output Q  
F/R  
CLK  
Rise  
All the data are memorized into the latch stage  
when the strobe input (STB) is pulled high.  
H
H
L
IN  
IN  
OUT Forward Shift  
OUT Steady  
H or L  
Rise  
Blanking input (BLK) forces the power outputs to  
high level when pulled high with polarity input  
OUT  
IN  
IN  
Reverse Shift  
Steady  
L
H or L OUT  
7/15  
3
1...45678910...15

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型号 品牌 描述 获取价格 数据表
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