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STV7618WAF

更新时间： 2024-01-19 11:51:34
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 驱动器
页数 文件大小 规格书
16页 127K
描述
PLASMA DISPLAY PANEL DATA DRIVER

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STV7618WAF 技术参数

生命周期：Obsolete零件包装代码：DIE
包装说明：DIE-120针数：120
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.84
Is Samacsys：N数据输入模式：PARALLEL
接口集成电路类型：DC PLASMA DISPLAY DRIVERJESD-30 代码：R-XUUC-N120
复用显示功能：NO功能数量：1
区段数：96端子数量：120
最高工作温度：85 °C最低工作温度：-20 °C
封装主体材料：UNSPECIFIED封装代码：DIE
封装等效代码：DIE OR CHIP封装形状：RECTANGULAR
封装形式：UNCASED CHIP电源：5 V
认证状态：Not Qualified子类别：Display Drivers
最大压摆率：0.1 mA最大供电电压：5.5 V
最小供电电压：4.5 V标称供电电压：5 V
表面贴装：YES技术：BCD
温度等级：OTHER端子形式：NO LEAD
端子位置：UPPER最小 fmax：40 MHz
Base Number Matches：1

STV7618WAF 数据手册

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STV7618  
4 - DATA BUS CONFIGURATION  
BS F/R Input  
Data Shift  
CLK  
01  
02  
03  
04  
05  
06  
...  
11  
12  
13  
14  
15  
16  
A1  
A2  
A3  
A4  
A5  
A6  
Out  
Out  
Out  
Out  
Out  
Out  
01  
02  
03  
04  
05  
06  
07  
08  
09  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
25  
26  
27  
28  
29  
30  
31  
32  
33  
34  
35  
36  
61  
62  
63  
64  
65  
66  
67  
68  
69  
70  
71  
72  
73  
74  
75  
76  
77  
78  
79  
80  
81  
82  
83  
84  
85  
86  
87  
88  
89  
90  
91  
92  
93  
94  
95  
96  
For-  
ward  
L
L
L
Shift  
A1  
A2  
A3  
A4  
A5  
A6  
Out  
Out  
Out  
Out  
Out  
Out  
91  
92  
93  
94  
95  
96  
85  
86  
87  
88  
89  
90  
79  
80  
81  
82  
83  
84  
73  
74  
75  
76  
77  
78  
67  
68  
69  
70  
71  
72  
61  
62  
63  
64  
65  
66  
31  
32  
33  
34  
35  
36  
25  
26  
27  
28  
29  
30  
19  
20  
21  
22  
23  
24  
13  
14  
15  
16  
17  
18  
07  
08  
09  
10  
11  
12  
01  
02  
03  
04  
05  
06  
Re-  
verse  
H
Shift  
CLK  
01  
02  
03  
04  
05  
06  
...  
27  
28  
29  
30  
31  
32  
A1  
A2  
A3  
Out  
Out  
Out  
01  
02  
03  
04  
05  
06  
07  
08  
09  
10  
11  
12  
13  
14  
15  
16  
17  
18  
79  
80  
81  
82  
83  
84  
85  
86  
87  
88  
89  
90  
91  
92  
93  
94  
95  
96  
For-  
ward  
H
H
L
A1  
A2  
A3  
Out  
Out  
Out  
94  
95  
96  
91  
92  
93  
88  
89  
90  
85  
86  
87  
82  
83  
84  
79  
80  
81  
16  
17  
18  
13  
14  
15  
10  
11  
12  
07  
08  
09  
04  
05  
06  
01  
02  
03  
Re-  
verse  
H
This table describes the position of the first data sampled by the first rising edge of the CLK signal. For the  
first configuration described in the above table, (BS = “L” and F/R= “L”), data on A1 bus sampled by the  
1st clock pulse is applied on Output1. After 16 clock pulses this data will be shifted to Output 91.  
8/15  
1...567891011...16

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