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SLGSSTVF16859H-TR

更新时间： 2024-02-18 06:20:55

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DDR 13 to 26 Bit Registered Buffer

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SLGSSTVF16859H-TR 数据手册

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SLGSSTVF16859H/V

DDR 13 to 26 Bit Registered Buffer

Applications:

•

PC1600/2100/2700/3200 DDR memory modules

1:2 Outputs for stacked DDR DIMMS

SSTL_2 compatible data registers

Features:

Pin Configuration

•

Compatible with JEDEC standard SSTV16859

Differential Clock inputs

Q13A

Q12A

Q11A

Q10A

Q9A

VDDQ

GND

D13

SSTL_2 data input signaling

Supports SSTL_2 class I output specifications

Output circuitry minimizes effects of SSO

and unterminated lines

D12

VDD

VDDQ

GND

D11

VDDQ

GND

Q8A

•

LVCMOS input levels on RESET pin

2.3V-2.7V Operation for PC1600/2100/2700

2.5V-2.7V Operation for PC3200

Max Clock frequency > 210MHz

Q7A

D10

Q6A

Q5A

GND

Q4A

Q3A

Q2A

RESET

GND

CLK

VDDQ

VDD

VREF

GND

Q1A

Block Diagram

Q13B

VDDQ

Q12B

Q11B

Q10B

Q9B

CLK

GND

Q8B

Q7B

Q6B

RESET

Q1A

Q1B

GND

VDDQ

Q5B

GND

VDDQ

VDD

CLK

Q4B

Q3B

Q2B

GND

VDDQ

VREF

Q1B

64-Pin TSSOP

6.1mm body, 0.50mm pitch

To 12 other channels

Truth Table

Notes:

1. H = High Signal Level

L = Low Signal Level

= Transition LOW-to-HIGH

= Transition HIGH-to-LOW

X = Don’t care

Q Outputs

Inputs

RESET CLK

CLK

X, or

Floating Floating Floating

2. Output level prior to indicated steady state

input conditions established.

(2)

L or H L or H

Q₀

Silego Technology Inc.

(408) 327-8800

PRELIMINARY

Data is subject to change.

May 28, 2003

12 3 4 5 6 7...11

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型号	品牌	获取价格	描述	数据表
SLGSSTVF16859V	ETC	获取价格	DDR 13 to 26 Bit Registered Buffer
SLGSSTVF16859V-TR	ETC	获取价格	DDR 13 to 26 Bit Registered Buffer
SLH_W20N50S	Maplesemi	获取价格	TO-247&TO-3P
SLH_W9N90C	Maplesemi	获取价格	TO-247&TO-3P
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