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NJU7702F4-42

更新时间: 2024-02-07 12:00:17
品牌 Logo 应用领域
NJRC ISM频段光电二极管
页数 文件大小 规格书
7页 46K
描述
Power Supply Support Circuit, Fixed, 1 Channel, CMOS, PDSO5, SOT-23, 5 PIN

NJU7702F4-42 技术参数

是否无铅: 不含铅是否Rohs认证: 符合
生命周期:Active零件包装代码:SOT-23
包装说明:LSSOP,针数:5
Reach Compliance Code:compliantECCN代码:EAR99
HTS代码:8542.39.00.01风险等级:5.68
可调阈值:NO模拟集成电路 - 其他类型:POWER SUPPLY SUPPORT CIRCUIT
JESD-30 代码:R-PDSO-G5JESD-609代码:e6
长度:2.9 mm信道数量:1
功能数量:1端子数量:5
最高工作温度:85 °C最低工作温度:-40 °C
封装主体材料:PLASTIC/EPOXY封装代码:LSSOP
封装形状:RECTANGULAR封装形式:SMALL OUTLINE, LOW PROFILE, SHRINK PITCH
峰值回流温度(摄氏度):260认证状态:Not Qualified
座面最大高度:1.3 mm最大供电电压 (Vsup):9 V
最小供电电压 (Vsup):0.8 V标称供电电压 (Vsup):1.2 V
表面贴装:YES技术:CMOS
温度等级:INDUSTRIAL端子面层:TIN BISMUTH
端子形式:GULL WING端子节距:0.95 mm
端子位置:DUAL处于峰值回流温度下的最长时间:NOT SPECIFIED
宽度:1.6 mmBase Number Matches:1

NJU7702F4-42 数据手册

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NJU7702/03  
DETECTION VOLTAGE RANK LIST  
3Device Name  
NJU7702/03F-13  
NJU7702/03F-27  
NJU7702/03F-42  
NJU7702/03F-06  
VDET  
1.3V  
2.7V  
4.2V  
6.0V  
NJU7702  
ABSOLUTE MAXIMUM RATINGS  
PARAMETER SYMBOL  
Input Voltage  
Output Voltage  
Output Current  
(Ta=25°C)  
RATINGS  
+10  
VSS-0.3 +10  
50  
UNIT  
V
V
mA  
mW  
°C  
VDD  
VOUT  
IOUT  
PD  
Power Dissipation  
Operating Temperature  
Storage Temperature  
200  
Topr  
Tstg  
40 +85  
40 +125  
°C  
ELECTRICALCHARACTERISTICS  
(Ta=25°C)  
PARAMETER  
Detection Voltage  
SYMBOL  
VDET  
TEST CONDITION  
MIN. TYP. MAX. UNIT  
-1.0%  
VDET  
×0.03 ×0.05 ×0.08  
+1.0%  
VDET  
V
VDET  
Hysteresis Voltage  
Quiescent Current  
VHYS  
ISS  
V
0.5  
0.8  
2.0  
7.0  
1.0  
1.6  
VDET=1.3V 1.7V Version  
VDET=1.8V 6.0V Version  
VDD=1.2V  
0.75  
4.5  
µA  
µA  
mA  
mA  
µA  
VDD=VDET+1V  
Output Current  
IOUT  
Nch,VDS=0.5V  
VDD=VOUT=9V  
VDD=2.4V (2.7V Version)  
0.1  
Output Leak Current  
ILEAK  
Detection  
Voltage  
Temperature  
Coefficient  
Operating Voltage  
(*note 2)  
VDET /Ta Ta=0 +85°C  
VDD  
±100  
ppm/°C  
0.8  
9
V
RL=100kΩ  
(*note 2): The minimum Operating Voltage(VOPL) indicates the same value of the output voltage(VOUT) on  
condition that VOUT becomes 10% or less of the input voltage(VDD).  
Ver.2004-08-04  
- 2 -  

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