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MT91L62AS

更新时间： 2024-01-09 03:31:16

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MITEL		解码器编解码器
页数	文件大小	规格书
17页	81K
描述
ISO2-CMOS 3 Volt Single Rail Codec

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技术参数
数据手册

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MT91L62AS 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
包装说明：	DIP, DIP20,.3	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.36
Is Samacsys：	N	压伸定律：	A/MU-LAW
滤波器：	YES	最大增益公差：	1.6 dB
JESD-30 代码：	R-PDIP-T20	JESD-609代码：	e0
长度：	25.195 mm	线性编码：	NOT AVAILABLE
功能数量：	1	端子数量：	20
工作模式：	SYNCHRONOUS/ASYNCHRONOUS	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	DIP	封装等效代码：	DIP20,.3
封装形状：	RECTANGULAR	封装形式：	IN-LINE
峰值回流温度（摄氏度）：	225	电源：	3 V
认证状态：	Not Qualified	座面最大高度：	5.33 mm
子类别：	Codecs	最大压摆率：	0.01 mA
标称供电电压：	3 V	表面贴装：	NO
技术：	CMOS	电信集成电路类型：	PROGRAMMABLE CODEC
温度等级：	INDUSTRIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	7.62 mm	Base Number Matches：	1

MT91L62AS 数据手册

ISO²-CMOS

MT91L62

3 Volt Single Rail Codec

Advance Information

DS5179

ISSUE 4

August 1999

Features

Ordering Information

•

Single 2.7-3.6 volt supply

MT91L62AE

MT91L62AS

MT91L62AN 20 Pin SSOP

20 Pin Plastic DIP (300 mil)

20 Pin SOIC

Programmable µ−law/A-law Codec and ﬁlters

Fully differential to output driver

SSI digital interface

Individual transmit and receive mute controls

0dB gain in receive path

-40°C to +85°C

6dB gain in transmit path

Description

Low power operation

The MT91L62 3V single rail Codec incorporates a

built-in Filter/Codec, transmit anti-alias ﬁlter, a

reference voltage and bias source. The device

supports both A-law and µ-law requirements. The

MT91L62 is a true 3V device employing a fully

differential architecture to ensure wide dynamic

range.

ITU-T G.714 compliant

Applications

•

Cellular radio sets

Local area communications stations

Line cards

An analog output driver is provided, capable of

driving a 20k ohm load.

Battery operated equipment

The MT91L62 is fabricated in Mitel's ISO -CMOS

technology ensuring low power consumption and

high reliability.

FILTER/CODEC GAIN

AIN+

AIN-

VDD

ENCODER

DECODER

6dB

VSSA

0 dB

Analog

VBias

VRef

Interface

AOUT +

AOUT -

Din

Timing

Dout

STB

PCM

Serial

Interface

CLOCKin

Control

A/µ

CSL0 CSL1 CSL2 RXMute TXMute

PWRST

Figure 1 - Functional Block Diagram

7-173

12 3 4 5 6 7...17

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