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MC74ACT160NC

更新时间： 2024-09-29 13:11:19
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 计数器
页数 文件大小 规格书
14页 326K
描述
ACT SERIES, SYN POSITIVE EDGE TRIGGERED 4-BIT UP DECADE COUNTER, PDIP16, PLASTIC, DIP-16

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MC74ACT160NC 技术参数

生命周期：Obsolete零件包装代码：DIP
包装说明：DIP,针数：16
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.83Is Samacsys：N
计数方向：UP系列：ACT
JESD-30 代码：R-PDIP-T16长度：19.175 mm
负载/预设输入：YES逻辑集成电路类型：DECADE COUNTER
工作模式：SYNCHRONOUS位数：4
功能数量：1端子数量：16
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装形状：RECTANGULAR封装形式：IN-LINE
认证状态：Not Qualified座面最大高度：4.44 mm
最大供电电压 (Vsup)：6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：CMOS温度等级：INDUSTRIAL
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL触发器类型：POSITIVE EDGE
宽度：7.62 mmBase Number Matches：1

MC74ACT160NC 数据手册

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SYNCHRONOUS  
PRESETTABLE  
BCD DECADE COUNTER  
The MC74AC160/74ACT160 and MC74AC162/74ACT162 are high-speed  
synchronous decade counters operating in the BCD (8421) sequence. They  
are synchronously presettable for application in programmable dividers and have  
two types of Count Enable inputs plus a Terminal Count output for versatility in  
forming synchronous multistage counters. The MC74AC160/74ACT160 has an  
asynchronous Master Reset input that overrides all other inputs and forces the  
outputs LOW. The MC74AC162/74ACT162 has a Synchronous Reset input that  
overrides counting and parallel loading and allows all outputs to be simultaneously  
reset on the rising edge of the clock.  
N SUFFIX  
CASE 648-08  
PLASTIC  
• Synchronous Counting and Loading  
• High-Speed Synchronous Expansion  
• Typical Count Rate of 120 MHz  
• Outputs Source/Sink 24 mA  
• ′ACT160 and ′ACT162 Have TTL Compatible Inputs  
V
TC  
15  
Q
Q
Q
Q
3
CET  
10  
PE  
9
CC  
0
1
2
16  
14  
13  
12  
11  
D SUFFIX  
CASE 751B-05  
PLASTIC  
LOGIC SYMBOL  
8
1
2
3
4
5
6
7
*R  
CP  
P
P
P
P
3
CEP GND  
0
1
2
PE P  
P
P
P
0
1
2
3
PIN NAMES  
CEP  
CET  
TC  
CEP  
CET  
CP  
Count Enable Parallel Input  
Count Enable Trickle Input  
Clock Pulse Input  
CP  
*R Q  
Q
Q
Q
0
1
2
3
MR  
SR  
P –P  
0
PE  
(′160) Asynchronous Master Reset Input  
(′162) Synchronous Reset Input  
Parallel Data Inputs  
3
*MR for  
*SR for  
′
160  
Parallel Enable Input  
′
162  
Q –Q  
TC  
Flip-Flop Outputs  
Terminal Count Output  
0
3
FACT DATA  
5-1  
1234567...14

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