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M66850FP

更新时间： 2024-02-21 12:04:23

品牌	Logo	应用领域
三菱 - MITSUBISHI		存储静态存储器先进先出芯片
页数	文件大小	规格书
15页	120K
描述
SRAM TYPE FIFO MEMORY

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M66850FP 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	LQFP, QFP32,.35SQ,32
针数：	32	Reach Compliance Code：	unknown
ECCN代码：	EAR99	HTS代码：	8542.32.00.71
风险等级：	5.37	最长访问时间：	15 ns
最大时钟频率 (fCLK)：	40 MHz	周期时间：	25 ns
JESD-30 代码：	S-PQFP-G32	JESD-609代码：	e0
长度：	7 mm	内存密度：	576 bit
内存集成电路类型：	OTHER FIFO	内存宽度：	9
功能数量：	1	端子数量：	32
字数：	64 words	字数代码：	64
工作模式：	SYNCHRONOUS	最高工作温度：	70 °C
最低工作温度：		组织：	64X9
可输出：	YES	封装主体材料：	PLASTIC/EPOXY
封装代码：	LQFP	封装等效代码：	QFP32,.35SQ,32
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE
并行/串行：	PARALLEL	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	5 V	认证状态：	Not Qualified
座面最大高度：	1.7 mm	最大待机电流：	0.0005 A
子类别：	FIFOs	最大压摆率：	0.07 mA
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	0.8 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	7 mm
Base Number Matches：	1

M66850FP 数据手册

MITSUBISHI <DIGITAL ASSP>

M66850J/FP, M66851J/FP

M66852J/FP, M66853J/FP

SRAM TYPE FIFO MEMORY

PIN CONFIGURATION (TOP VIEW)

DESCRIPTION

M66850/851/852/853 are very high-speed and clock synchronous

FIFO(First-In,First-Out) memories fabricated by high-speed CMOS

technology.

These FIFOs are applicable for a data buffer as networks and

communications.

The write operation is controlled by a write clock pin(WCLK) and

two write enable pins(WEN1,WEN2).

Data present at the data input pins(D0-D8) is written into the

Synchronous FIFO on every rising write clock edge when the

device is enabled for writing.

WEN1

WCLK

WEN2/LD

VCC

PAF

PAE

GND

REN1

RCLK

REN2

The read operation is controlled by a read clock pin(RCLK) and

two read enable pins(REN1,REN2).

Data is read from the Synchronous FIFO on every rising read clock

edge when the device is enabled for reading. An output enable

pin(OE) controls the states of the data output pins(Q0-Q8).

MITSUBISHI FIFOs have four flags (EF,FF,PAE,PAF). The empty

flag EF and the full flag FF are fixed flags. The almost empty flag

PAE and the almost full flag PAF are programmable flags. The

programmable flag offset is initiated by the load pin(LD).

Outline 32P0(M66850 – 853J)

FEATURES

• Memory configuration

64words x 9bits (M66850J/FP)

256words x 9bits (M66851J/FP)

512words x 9bits (M66852J/FP)

1024words x 9bits (M66853J/FP)

WEN1

WCLK

PAF

WEN2/LD

• Write and Read Clocks can be independent

• Advanced CMOS technology

• Programmable Almost-Empty and Almost-Full flags

• High-speed : 25ns cycle time

PAE

VCC

GND

REN1

RCLK

REN2

• Package Available :

32-pin Pastic Leaded Chip Carrier(PLCC)

32-pin Low profile Quad Flat Package(LQFP)

APPLICATION

• Data Buffer for networks communications.

Outline 32P6B(M66850 – 853FP)

D0-D8

–

BLOCK DIAGRAM

RESET

LOGIC

WCLK

WEN1

WEN2

INPUT

OFFSET

WRITE

READ

CONTROL

POINTER

MEMORY

ARRAY

READ

CONTROL

WRITE

POINTER

RCLK

REN1

REN2

OUTPUT

PAE

PAF

FLAG

LOGIC

–

Q0-Q8

12 3 4 5 6 7...15

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M66850FP 替代型号

型号	品牌	替代类型	描述	数据表
IDT72421L50PF	IDT	功能相似	CMOS SyncFIFO 64 X 9, 256 x 9, 512 x 9, 1024 X 9, 2048 X 9 and 4096 x 9
IDT72421L20PF	IDT	功能相似	CMOS SyncFIFO 64 X 9, 256 x 9, 512 x 9, 1024 X 9, 2048 X 9 and 4096 x 9
IDT72421L15PF	IDT	功能相似	CMOS SyncFIFOO 64 X 9, 256 x 9, 512 x 9, 1024 X 9, 2048 X 9 and 4096 x 9

与M66850FP相关器件

型号	品牌	获取价格	描述	数据表
M66850J	MITSUBISHI	获取价格	SRAM TYPE FIFO MEMORY
M66851FP	MITSUBISHI	获取价格	SRAM TYPE FIFO MEMORY
M66851J	MITSUBISHI	获取价格	SRAM TYPE FIFO MEMORY
M66852FP	MITSUBISHI	获取价格	SRAM TYPE FIFO MEMORY
M66852J	MITSUBISHI	获取价格	SRAM TYPE FIFO MEMORY
M66853FP	MITSUBISHI	获取价格	SRAM TYPE FIFO MEMORY
M66853J	MITSUBISHI	获取价格	SRAM TYPE FIFO MEMORY
M66-86	MICRO-ELECTRONICS	获取价格	Tone/Music Synthesizer, PBCY3, TO-92
M66-88	MICRO-ELECTRONICS	获取价格	Tone/Music Synthesizer, PBCY3, TO-92
M66-93	MICRO-ELECTRONICS	获取价格	Tone/Music Synthesizer, PBCY3, TO-92

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