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M65617SP

更新时间： 2024-02-27 21:35:46
品牌 Logo 应用领域
三菱 - MITSUBISHI 消费电路商用集成电路光电二极管
页数 文件大小 规格书
15页 77K
描述
PICTURE-IN-PICTURE SIGNAL PROCESSING

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M65617SP 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：SDIP, SDIP52,.6
针数：52Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.92
Is Samacsys：N商用集成电路类型：CONSUMER CIRCUIT
JESD-30 代码：R-PDIP-T52JESD-609代码：e0
长度：45.85 mm功能数量：1
端子数量：52最高工作温度：75 °C
最低工作温度：-10 °C封装主体材料：PLASTIC/EPOXY
封装代码：SDIP封装等效代码：SDIP52,.6
封装形状：RECTANGULAR封装形式：IN-LINE, SHRINK PITCH
峰值回流温度（摄氏度）：NOT SPECIFIED电源：3.3 V
认证状态：Not Qualified座面最大高度：5.5 mm
子类别：Superimposer ICs最大压摆率：140 mA
最大供电电压 (Vsup)：3.5 V最小供电电压 (Vsup)：3.1 V
表面贴装：NO温度等级：COMMERCIAL EXTENDED
端子面层：Tin/Lead (Sn/Pb)端子形式：THROUGH-HOLE
端子节距：1.778 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：15.24 mm
Base Number Matches：1

M65617SP 数据手册

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MITSUBISHI ICs (TV)  
M65617SP  
PICTURE-IN-PICTURE SIGNAL PROCESSING  
DESCRIPTION OF PIN  
Pin No.  
Name  
AVss3 (VCXO)  
VCXO out  
VCXO in  
FILTER  
I/O  
Function  
Remarks  
1
2
GND Grounding (analog burst lock PLL section)  
O
I
Oscillation output signal  
3
Oscillation input signal  
4
O
O
Filter  
Bias  
5
BIAS  
6
AVdd3 (VCXO)  
AVdd2 (m)  
Vin (m)  
Vdd Power supply (analog burst lock PLL section)  
Vdd Power supply (analog main signal A/D section)  
7
8
I
Main color input signal  
9
Vrt (m)  
O
O
Main signal A/D reference voltage output +  
Main signal A/D reference voltage output -  
10  
11  
12  
13  
14  
15  
16  
Vrb (m)  
AVss2 (m)  
AVdd1 (s)  
Vin (s)  
GND Grounding (analog main signal A/D section)  
Vdd Power supply (analog sub-signal A/D section)  
I
Sub-composite video input signal  
Vrt (s)  
O
O
Sub-signal A/D reference voltage output +  
Sub-signal A/D reference voltage output -  
Vrb (s)  
AVss1 (s)  
GND Grounding (analog sub-signal A/D section)  
Power-ON reset input signal.  
Connected to the power supply with  
100kΩ, and grounded with 10µF  
17  
RESET  
I
18  
19  
20  
21  
22  
23  
24  
25  
26  
27  
28  
29  
30  
31  
32  
DVss1  
GND Grounding (digital section)  
DVdd1  
Vdd Power supply (digital section)  
(I/)O Sub-screen burst gate pulse output  
BGP(s)/TEST0  
Open  
SCK  
CSYNC(s)/TEST1  
I
Sub-screen 4fsc clock input  
Grounding  
Pulldown 15kΩ  
I(/O) Sub-screen CSYNC input  
I2C bus data/acknowledge output signal  
I2C bus data input signal  
ACK  
O
I
DATA  
I2C bus clock input signal  
CLK  
I
DVss2  
DVdd2  
BGP(m)/TEST2  
GND Grounding (digital section)  
Vdd Power supply (digital section)  
(I/)O For testing  
Open  
fsc/TEST3  
MCK  
I(/O) For testing  
Pulldown 15kΩ  
Grounding  
Open  
I
For testing  
SWM/TEST4 (I/)O For testing  
HD/TEST5  
I(/O) Horizontal sync input signal  
VD/CSYNC/  
TEST6  
33  
I(/O) Vertical sync input signal  
SWMG/TEST7  
DVdd3 (ram)  
DVss3 (ram)  
Cout-sub  
ADJ-Csub  
Yout-sub  
ADJ-Ysub  
Y-PIPin  
34  
35  
36  
37  
38  
39  
40  
41  
42  
43  
44  
45  
46  
47  
48  
49  
50  
51  
52  
I(/O) Sub-screen display authorization input signal  
Vdd Power supply (digital RAM section)  
GND Grounding (digital RAM section)  
Pullup 15kΩ  
O
O
O
O
I
Sub-screen color signal D/A output signal  
For adjustment of sub-screen color signal D/A  
Sub-screen luminance signal D/A output signal  
For adjustment of sub-screen luminance signal D/A  
Sub-screen luminance signal re-input signal  
AVss4 (da)  
C-PIPin  
GND Grounding (analog D/A and SW sections)  
Sub-screen color signal re-input signal  
Vdd Power supply (analog D/A & SW sections)  
I
AVdd4 (da)  
C-PIP  
O
I
PIP color signal output signal  
For testing  
TEST8  
Pullup 15kΩ  
Grounding  
Grounding  
Y-PIP  
O
I
PIP luminance signal output signal  
For testing  
TEST9  
Yin  
I
Main luminance input signal  
For testing  
TESTEN  
Cin  
I
I
Main color input signal  
AVssf (ana)  
Vss Grounding (analog section)  
3
1234567...15

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