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M5-192/104-10VC

更新时间： 2024-01-04 08:10:42
品牌 Logo 应用领域
莱迪思 - LATTICE /
页数 文件大小 规格书
47页 1092K
描述
Fifth Generation MACH Architecture

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M5-192/104-10VC 技术参数

是否Rohs认证： 不符合生命周期：Transferred
Reach Compliance Code：unknown风险等级：5.72
Is Samacsys：N其他特性：YES
最大时钟频率：83 MHz系统内可编程：YES
JESD-30 代码：S-PQFP-G144JESD-609代码：e0
JTAG BST：YES专用输入次数：
I/O 线路数量：104宏单元数：192
端子数量：144最高工作温度：85 °C
最低工作温度：-40 °C组织：0 DEDICATED INPUTS, 104 I/O
输出函数：MACROCELL封装主体材料：PLASTIC/EPOXY
封装代码：QFP封装等效代码：QFP144,1.2SQ
封装形状：SQUARE封装形式：FLATPACK
电源：5 V可编程逻辑类型：EE PLD
传播延迟：16 ns认证状态：Not Qualified
子类别：Programmable Logic Devices最大供电电压：5.5 V
最小供电电压：4.5 V标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：0.635 mm
端子位置：QUADBase Number Matches：1

M5-192/104-10VC 数据手册

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1
Table 1 . MACH 5 Device Features  
M5-128/1  
M5LV-128  
M5-192/1  
M5-256/1  
M5LV-256  
M5-320  
M5LV-320  
M5-384  
M5LV-384  
M5-512  
M5LV-512  
Feature  
Supply Voltage (V)  
5
3.3  
5
5
3.3  
5
3.3  
5
3.3  
5
3.3  
Macrocells  
128  
120  
5.5  
3.0  
4.5  
182  
35  
128  
120  
5.5  
3.0  
4.5  
182  
35  
192  
120  
5.5  
3.0  
4.5  
182  
45  
256  
160  
5.5  
3.0  
4.5  
182  
55  
256  
160  
5.5  
3.0  
4.5  
182  
55  
320  
192  
320  
192  
384  
160  
384  
192  
512  
256  
512  
256  
Maximum User I/O Pins  
2
2
2
2
2
2
t
(ns)  
6.5  
6.5  
6.5  
6.5  
6.5  
6.5  
PD  
2
2
2
2
2
2
t (ns)  
3.0  
3.0  
3.0  
3.0  
3.0  
3.0  
SS  
2
2
2
2
2
2
t
(ns)  
5.0  
5.0  
5.0  
5.0  
5.0  
5.0  
COS  
2
2
2
2
2
2
f
(MHz)  
167  
70  
167  
70  
167  
75  
167  
75  
167  
100  
Yes  
Yes  
167  
100  
Yes  
Yes  
CNT  
Typical Static Power (mA)  
IEEE 1149.1 Boundary Scan Compliant  
PCI-Compliant  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Yes  
Note:  
1. “M5-xxx” is for 5-V devices. “M5LV-xxx” is for 3.3-V devices.  
2. Preliminary specifications for new 6.5ns (Tpd) speed grade. 7.5ns speed grade in production now.  
GENERAL DESCRIPTION  
®
The MACH 5 family consists of a broad range of high-density and high-I/O Complex  
Programmable Logic Devices (CPLDs). The fifth-generation MACH architecture yields fast speeds  
at high CPLD densities, low power, and supports additional features such as in-system  
programmability, Boundary Scan testability, and advanced clocking options (Table 1). The MACH  
5 family offers 5-V (M5-xxx) and 3.3-V (M5LV-xxx) operation.  
2
Manufactured in state-of-the-art ISO 9000 qualified fabrication facilities on E CMOS process  
technologies, MACH 5 devices are available with pin-to-pin delays as fast as 5.5 ns (Table 2). The  
5.5, 6.5, 7.5, 10, and 12-ns devices are compliant with the PCI Local Bus Specification.  
2
MACH 5 Family  
1234567...47

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