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LPC54102J512UK49

更新时间： 2024-01-09 20:52:14

品牌	Logo	应用领域
恩智浦 - NXP		时钟静态存储器外围集成电路
页数	文件大小	规格书
95页	2142K
描述
32-bit ARM Cortex-M4/M0 MCU; 104 kB SRAM; 512 kB flash, 3 x I2C, 2 x SPI, 4 x USART, 32-bit counter/ timers, SCTimer/PWM, 12-bit 5.0 Msamples/sec ADC

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LPC54102J512UK49 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	VFBGA,	Reach Compliance Code：	compliant
风险等级：	1.74	Is Samacsys：	N
具有ADC：	YES	地址总线宽度：
位大小：	32	最大时钟频率：	25 MHz
DAC 通道：	NO	DMA 通道：	YES
外部数据总线宽度：		JESD-30 代码：	S-PBGA-B49
长度：	3.29 mm	湿度敏感等级：	1
I/O 线路数量：	39	端子数量：	49
片上程序ROM宽度：	8	最高工作温度：	105 °C
最低工作温度：	-40 °C	PWM 通道：	YES
封装主体材料：	PLASTIC/EPOXY	封装代码：	VFBGA
封装形状：	SQUARE	封装形式：	GRID ARRAY, VERY THIN PROFILE, FINE PITCH
峰值回流温度（摄氏度）：	NOT SPECIFIED	RAM（字节）：	106496
ROM（单词）：	524288	ROM可编程性：	FLASH
座面最大高度：	0.58 mm	速度：	100 MHz
最大供电电压：	3.6 V	最小供电电压：	1.62 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子形式：	BALL	端子节距：	0.4 mm
端子位置：	BOTTOM	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	3.29 mm	uPs/uCs/外围集成电路类型：	MICROCONTROLLER, RISC
Base Number Matches：	1

LPC54102J512UK49 数据手册

LPC5410x

32-bit ARM Cortex-M4/M0+ MCU; 104 kB SRAM; 512 kB flash,

3 x I2C, 2 x SPI, 4 x USART, 32-bit counter/ timers,

SCTimer/PWM, 12-bit 5.0 Msamples/sec ADC

Rev. 2.11 — 19 September 2019

Product data sheet

1. General description

The LPC5410x are ARM Cortex-M4 based microcontrollers for embedded applications.

These devices include:

• Optional ARM Cortex-M0+ coprocessor.

• 104 kB of on-chip SRAM.

• Up to 512 kB on-chip flash.

• State-Configurable Timer with PWM capabilities (SCTimer/PWM).

• RTC/alarm timer.

• 24-bit Multi-Rate Timer (MRT).

• 12-bit 5.0 Msamples/sec ADC.

• Repetitive Interrupt Timer (RIT).

• Windowed Watchdog Timer (WWDT).

• Two SPIs.

• Three Fast-mode plus I²C-bus interfaces with high-speed slave mode.

• Four USARTs.

• Five general-purpose timers.

The ARM Cortex-M4 is a 32-bit core that offers system enhancements such as low power

consumption, enhanced debug features, and a high level of support block integration. The

ARM Cortex-M4 CPU incorporates a 3-stage pipeline, uses a Harvard architecture with

separate local instruction and data buses as well as a third bus for peripherals, and

includes an internal prefetch unit that supports speculative branching. The ARM

Cortex-M4 supports single-cycle digital signal processing and SIMD instructions. A

hardware floating-point unit is integrated in the core.

The ARM Cortex-M0+ coprocessor is an energy-efficient and easy-to-use 32-bit core

which is code and tool-compatible with the Cortex-M4 core. The Cortex-M0+ coprocessor

offers up to 150 MHz performance with a simple instruction set and reduced code size. In

LPC5410x, the Cortex-M0 coprocessor hardware multiply is implemented as a 32-cycle

iterative multiplier.

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