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LM9647SAMPLE-KIT

更新时间： 2024-02-19 10:05:43

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美国国家半导体 - NSC		传感器图像传感器
页数	文件大小	规格书
2页	82K
描述
LM9647 Color CMOS Image Sensor VGA 68 FPS

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LM9647SAMPLE-KIT 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
包装说明：	WQCCN,	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.92
模拟集成电路 - 其他类型：	ANALOG CIRCUIT	JESD-30 代码：	S-CQCC-N48
JESD-609代码：	e0	长度：	14.22 mm
功能数量：	1	端子数量：	48
最高工作温度：	50 °C	最低工作温度：	-10 °C
封装主体材料：	CERAMIC, METAL-SEALED COFIRED	封装代码：	WQCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER, WINDOW
峰值回流温度（摄氏度）：	NOT SPECIFIED	认证状态：	Not Qualified
座面最大高度：	2.58 mm	最大供电电压 (Vsup)：	3.3 V
最小供电电压 (Vsup)：	2.7 V	标称供电电压 (Vsup)：	3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	NO LEAD	端子节距：	1.02 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	14.22 mm	Base Number Matches：	1

LM9647SAMPLE-KIT 数据手册

ADVANCE INFORMATION

May 2002

LM9647 Color CMOS Image Sensor VGA 68 FPS

General Description

Applications

The LM9647 is a high performance, low power, 1/4" VGA CMOS

Active Pixel Sensor capable of capturing color still or motion

images and converting them to a digital data stream.

f Dual Mode Camera

f Digital Still Camera

f Security Camera

f Machine Vision

Excellent image quality is achieved by integrating a high perfor-

mance analog signal processor comprising of a high speed 10

bit A/D convertor, fixed pattern noise elimination circuits and

separate color gain amplifiers. The offset and black level can be

automatically adjusted on chip using a full loop black level com-

pensation circuit.

Key Specifications

Total: 488 x 672

Active: 488 x 648

Array Format

Total: 2.93mm x 4.03mm

Active: 2.93mm x 3.89mm

Furthermore, a programmable smart timing and control circuit

allowing the user maximum flexibility in adjusting integration

time, active window size, gain, frame rate. Various control, tim-

ing and power modes are also provided.

Effective Image Area

Optical Format

Pixel Size

1/4"

6.0mm x 6.0mm

8 & 10 Bit Digital

68 frames per second

57 dB

Video Outputs

Frame Rate

Dynamic Range

Electronic Shutter

FPN

Features

f Master and slave mode operation

f Progressive scan read out with horizontal and vertical flip

f Programmable Exposure:

Rolling Reset

0.5%

Master clock divider

Inter row delay

Inter frame delay

PRMU

1.7%

Partial frame integration

Sensitivity

2.5 volts/lux.s

49%

f Four channels of digitally programmable analog gain

f Full automatic servo loop for black level & offset adjustment

on each gain channel

f Horizontal & vertical sub-sampling (2:1 & 4:2) with averaging

f Windowing

Fill Factor

Color Mosaic

Package

Bayer pattern

32 LCC

f Programmable pixel clock, inter-frame and inter-line delays

Single Supply

Power Consumption

Operating Temp

3.0V +/-10%

130mW

f I C compatible serial control interface

f Power on reset & power down mode

-10 C to 50 C

Overall Chip Block Diagram

sclk sda sadr

resetb

POR

pwd

mclk

APS Array

I C Compatible

Serial I/F

Power

Control

Bank

clk gen

snapshot

extsync

Master Sensor Controller

+/-

ch0

d[9:0]

pclk

ch1

ch2

ch3

MUX

10 bit A/D

Column CDS

hsync

vsync

Figure 1. Chip Block Diagram

ã 2002 National Semiconductor Corporation

www.national.com

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型号	品牌	描述	获取价格	数据表
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