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EPF8452AQI160-3

更新时间： 2024-02-10 08:13:56

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英特尔 - INTEL		/
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62页	903K
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Loadable PLD, CMOS, PQFP160, PLASTIC, QFP-160

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EPF8452AQI160-3 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	QFP, QFP160,1.2SQ	针数：	160
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.2
其他特性：	336 LOGIC ELEMENTS	最大时钟频率：	385 MHz
JESD-30 代码：	S-PQFP-G160	JESD-609代码：	e0
长度：	28 mm	湿度敏感等级：	3
专用输入次数：	4	I/O 线路数量：	120
输入次数：	120	逻辑单元数量：	336
输出次数：	116	端子数量：	160
最高工作温度：	85 °C	最低工作温度：	-40 °C
组织：	4 DEDICATED INPUTS, 120 I/O	输出函数：	REGISTERED
封装主体材料：	PLASTIC/EPOXY	封装代码：	QFP
封装等效代码：	QFP160,1.2SQ	封装形状：	SQUARE
封装形式：	FLATPACK	峰值回流温度（摄氏度）：	220
电源：	3.3/5,5 V	可编程逻辑类型：	LOADABLE PLD
认证状态：	Not Qualified	座面最大高度：	4.07 mm
子类别：	Field Programmable Gate Arrays	最大供电电压：	5.5 V
最小供电电压：	4.5 V	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	28 mm	Base Number Matches：	1

EPF8452AQI160-3 数据手册

FLEX 8000 Programmable Logic Device Family Data Sheet

Notes to tables:

(1) Perform a complete thermal analysis before committing a design to this device package. See Application Note 74

(Evaluating Power for Altera Devices) for more information.

(2) This pin is a dedicated pin and is not available as a user I/O pin.

(3) SDOUTwill drive out during configuration. After configuration, it may be used as a user I/O pin. By default, the

MAX+PLUS II software will not use SDOUTas a user I/O pin; the user can override the MAX+PLUS II software and

use SDOUTas a user I/O pin.

(4) If the device is not configured to use the JTAG BST circuitry, this pin is available as a user I/O pin.

(5) JTAG pins are available for EPF8636A devices only. These pins are dedicated user I/O pins.

(6) If this pin is used as an input in user mode, ensure that it does not toggle before or during configuration.

(7) TRSTis a dedicated input pin for JTAG use. This pin must be grounded if JTAG BST is not used.

(8) Pin 52 is a V pin on EPF8452A devices only.

(9) The user I/O pin count includes dedicated input pins and all I/O pins.

(10) Unused dedicated inputs should be tied to ground on the board.

(11) SDOUTdoes not exist in the EPF8636GC192 device.

(12) These pins are no connect (N.C.) pins for EPF8636A devices only. They are user I/O pins in EPF8820A devices.

(13) EPF8636A devices have 132 user I/O pins; EPF8820A devices have 148 user I/O pins.

(14) For EPF81500A devices, these pins are dedicated JTAG pins and are not available as user I/O pins. If JTAG BST is

not used, TDI, TCK, TMS, and TRSTshould be tied to GND.

The information contained in the FLEX 8000 Programmable Logic Device

Family Data Sheet version 11.1 supersedes information published in

previous versions. The FLEX 8000 Programmable Logic Device Family Data

Sheet version 11.1 contains the following change: minor textual updates.

Revision

History

Altera Corporation

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