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EN5312QI

更新时间： 2024-02-07 02:20:31
品牌 Logo 应用领域
阿尔特拉 - ALTERA LTE输入元件开关
页数 文件大小 规格书
16页 978K
描述
Switching Regulator, Voltage-mode, 1A, 4000kHz Switching Freq-Max, 5 X 4 MM, 1.10 MM HEIGHT, ROHS COMPLIANT, MO-220, QFN-20

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EN5312QI 技术参数

是否Rohs认证： 符合生命周期：Not Recommended
包装说明：5 X 4 MM, 1.10 MM HEIGHT, ROHS COMPLIANT, MO-220, QFN-20Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.72其他特性：ADJUSTABLE MODE FROM 0.6 TO 4.9; ALSO OPERATES IN INPUT VG FOR EXT DIVIDER 2.4 TO 6.6V
模拟集成电路 - 其他类型：SWITCHING REGULATOR控制模式：VOLTAGE-MODE
控制技术：PULSE WIDTH MODULATION最大输入电压：5.5 V
最小输入电压：2.4 V标称输入电压：3.6 V
JESD-30 代码：R-XQCC-N20JESD-609代码：e3
长度：5 mm湿度敏感等级：3
功能数量：1端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
最大输出电流：1 A封装主体材料：UNSPECIFIED
封装代码：HQCCN封装等效代码：LCC20,.16X.2,25
封装形状：RECTANGULAR封装形式：CHIP CARRIER, HEAT SINK/SLUG
峰值回流温度（摄氏度）：260认证状态：Not Qualified
座面最大高度：1.15 mm子类别：Switching Regulator or Controllers
表面贴装：YES切换器配置：BUCK
最大切换频率：4000 kHz温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn) - annealed端子形式：NO LEAD
端子节距：0.65 mm端子位置：QUAD
处于峰值回流温度下的最长时间：10宽度：4 mm

EN5312QI 数据手册

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EN5312QI  
Pin Description  
other or to any external signal, voltage, or  
ground. One or more of these pins may be  
connected internally.  
VSENSE (Pin 15):  
Sense pin for output  
voltage regulation. Connect VSENSE to the  
output voltage rail as close to the terminal of  
the output filter capacitor as possible.  
VFB (Pin 16): Feedback pin for external divider  
option. When using the external divider option  
(VS0=VS1=VS2= high) connect this pin to the  
center of the external divider. Set the divider  
such that VFB = 0.603V.  
VS0,VS1,VS2 (Pin 17,18,19): Output voltage  
select. VS0=pin19, VS1=pin18, VS2=pin17.  
Selects one of seven preset output voltages or  
choose external divider by connecting pins to  
logic high or low. Logic low is defined as VLOW  
≤ 0.4V. Logic high is defined as VHIGH ≥ 1.4V.  
Any level between these two values is  
indeterminate.  
Figure 2. Pin description, top view.  
VIN (Pin 1,2): Input voltage pin. Supplies  
power to the IC.  
Input GND: (Pin 3): Input power ground.  
Connect this pin to the ground terminal of the  
ENABLE (Pin 20): Output enable. Enable =  
logic high, disable = logic low. Logic low is  
defined as VLOW ≤ 0.2V. Logic high is defined  
as VHIGH ≥ 1.4V. Any level between these two  
values is indeterminate.  
input  
capacitor.  
Refer  
to  
Layout  
Recommendations for further details.  
Output GND: (Pin 4): Power ground. The  
output filter capacitor should be connected  
between this pin and VOUT. Refer to Layout  
recommendations for further detail.  
Bottom Thermal Pad: Device thermal pad to  
remove heat from package. Connect to PCB  
surface ground pad and PCB internal ground  
plane (see layout recommendations).  
VOUT (Pin 5,6,7): Regulated output voltage.  
NC (Pin 8,9,10,11,12,13,14): These pins  
should not be electrically connected to each  
2
www.altera.com/enpirion  
04535  
December 14, 2015  
Rev E  
1234567...16

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