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DG202C

更新时间： 2024-02-09 04:40:22
品牌 Logo 应用领域
美信 - MAXIM 开关
页数 文件大小 规格书
12页 1339K
描述
Quad SPST CMOS Analog Switches

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DG202C 技术参数

生命周期：Transferred包装说明：CERAMIC, DIP
Reach Compliance Code：unknown风险等级：5.56
模拟集成电路 - 其他类型：SPSTJESD-30 代码：R-CDIP-T
信道数量：4功能数量：1
最大通态电阻 (Ron)：175 Ω封装主体材料：CERAMIC, METAL-SEALED COFIRED
封装形状：RECTANGULAR封装形式：IN-LINE
认证状态：Not Qualified最大供电电压 (Vsup)：44 V
表面贴装：NO最长接通时间：600 ns
端子形式：THROUGH-HOLE端子位置：DUAL
Base Number Matches：1

DG202C 数据手册

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Quad SPST CMOS Analog Switches  
ELECTRICAL CHARACTERISTICS (DG202)  
(5+ = +1ꢀ5, 5- = -1ꢀ5, GND = 0, T = full ꢀꢃeartꢄng temꢃerature range, unless otherwise noted.) (For more information on TYP  
A
values see Note 3.)  
DG202A  
DG202C, D, E  
TYP MAX  
PARAMETER  
SWITCH  
SYMBVL  
CVNDITIVNS  
UNITS  
MIN  
TYP MAX MIN  
Analog Signal Range  
5
-1ꢀ  
+1ꢀ  
2ꢀ0  
100  
-1ꢀ  
+1ꢀ  
2ꢀ0  
100  
5
ANALOG  
Drain-Source ON Resistance  
(Note ꢀ)  
R
5
5
5
5
= ±105, 5 = 2.±5, I = 1mA  
Ω
DS (ON)  
S (OFF)  
D (OFF)  
D
IN  
S
5 = 1±5, 5 = -1±5  
S
D
Source OFF-Leakage Current  
Drain OFF-Leakage Current  
I
= 0.ꢁ5  
= 0.ꢁ5  
= 2.±5  
IN  
IN  
IN  
5 = -1±5, 5 = 1±5  
-100  
-100  
-200  
-1.0  
-100  
-100  
-200  
-1.0  
S
D
5 = 1±5, 5 = -1±5  
100  
200  
100  
200  
S
D
I
nA  
µA  
5 = -1±5, 5 = 1±5  
S
D
5 = -1±5  
S
Drain ON-Leakage Current  
(Note 6)  
I
D (ON)  
5
= 1±5  
D
INPUT  
5
= 2.±5  
= 1ꢀ5  
IN  
IN  
Input Current with Input  
5oltage High  
I
INH  
5
1.0  
1.0  
Input Current with Input  
5oltage Low  
I
5
= 0  
-1.0  
-1.0  
INL  
IN  
Nꢀte .: Electrical characteristics, such as On-Resistance, will change when power supplies other than ±1ꢀ5, are used.  
Nꢀte 6: I  
is leakage from driver into “ON” switch.  
D (ON)  
Pin Description  
PIN  
NAME  
FUNCTIVN  
DIP/SV/TSSVP  
QFN/TQFN  
1, 16, 9, ꢁ  
1ꢀ, 1±, 7, 6  
IN1–IN±  
D1–D±  
S1–S±  
5-  
Input  
2, 1ꢀ, 10, 7  
16, 13, ꢁ, ꢀ  
Analog Switch Drain Terminal  
Analog Switch Source Terminal  
Negative-Supply 5oltage Input  
Ground  
3, 1±, 11, 6  
1, 12, 9, ±  
±
2
3
ꢀ
GND  
N.C.  
5+  
12  
13  
—
10  
11  
EP  
No Connection  
Positive-Supply 5oltage Input—Connected to Substrate  
Eꢂposed Pad. Connect eꢂposed pad to 5+ or leave EP unconnected.  
EP  
Switching Time Test Circuit  
Protecting Against Fault  
Conditions  
Fault conditions occur when power supplies are turned  
off when input signals are still present, or when over-  
voltages occur at the inputs during normal operation. In  
either case, source-to-body diodes can be forward  
biased and conduct current from the signal source. If  
Switch output waveform shown for 5 = constant with  
S
logic input waveform as shown. Note that 5 may be  
S
+ve or -ve as per switching times test circuit. 5 is the  
O
steady state output with switch on. Feedthrough via  
gate capacitance may result in spikes at leading and  
trailing edge of output waveform.  
_______________________________________________________________________________________  
.
12345678...12

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