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DAC1222LCN PDF预览

DAC1222LCN

更新时间： 2024-01-13 02:38:10
品牌 Logo 应用领域
美国国家半导体 - NSC 转换器数模转换器光电二极管
页数 文件大小 规格书
14页 266K
描述
10-Bit, 12-Bit Binary Multiplying D/A Converter

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DAC1222LCN 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：DIP, DIP18,.3Reach Compliance Code：unknown
ECCN代码：3A001.A.2.CHTS代码：8542.39.00.01
风险等级：5.85转换器类型：D/A CONVERTER
输入位码：OFFSET BINARY, COMPLEMENTARY BINARY输入格式：PARALLEL, 8 BITS
JESD-30 代码：R-GDIP-T18JESD-609代码：e0
最大线性误差 (EL)：0.2%位数：12
功能数量：1端子数量：18
最高工作温度：125 °C最低工作温度：-55 °C
封装主体材料：CERAMIC, GLASS-SEALED封装代码：DIP
封装等效代码：DIP18,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：15 V认证状态：Not Qualified
座面最大高度：5.08 mm标称安定时间 (tstl)：0.5 µs
子类别：Other Converters最大压摆率：2 mA
标称供电电压：15 V表面贴装：NO
技术：CMOS温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.62 mm
Base Number Matches：1

DAC1222LCN 数据手册

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Typical Applications  
The following applications are also valid for 12-bit systems  
using the DAC1220 and 2 additional digital inputs.  
Operational Amplifier V Adjust (Figure 3)  
OS  
Connect all digital inputs, A1–A10, to ground and adjust the  
g
1
is less than 10V, a finer  
potentiometer to bring the op amp V  
pin to within  
OUT  
Operational Amplifier Bias Current (Figure 3)  
mV from ground potential. If V  
REF  
adjustment is required. It is helpful to increase the reso-  
The op amp bias current, I , flows through the 15k internal  
b
feedback resistor. BI-FET op amps have low I and, there-  
V
OS  
b
lution of the V  
adjust procedure by connecting a 1 kX  
OS  
resistor between the inverting input of the op amp to  
ground. After V has been adjusted, remove the 1 kX.  
c
strongly recommended for the DAC1020 applications.  
fore, the 15k  
I error they introduce is negligible; they are  
b
OS  
V
OS  
Considerations  
Full-Scale Adjust (Figure 4)  
The output impedance, R , of the DAC is modulated by  
OUT  
the digital input code which causes a modulation of the op-  
Switch high all the digital inputs, A1–A10, and measure the  
op amp output voltage. Use a 500X potentiometer, as  
erational amplifier output offset. It is therefore recommend-  
E
c
shown, to bring  
1023/1024.  
V
to a voltage equal to V  
REF  
ll OUTll  
ed to adjust the op amp V . R  
OS OUT  
is 15k if more than 4  
E
digital inputs are high; R  
is high, and R  
is 45k if a single digital input  
approaches infinity if all inputs are low.  
OUT  
OUT  
SELECTING AND COMPENSATING THE OPERATIONAL AMPLIFIER  
Circuit Settling  
Circuit Small  
Signal BW  
Op Amp Family  
C
F
R
i
P
V
W
Time, t  
s
LF357  
LF356  
LF351  
LM741  
10 pF  
22 pF  
24 pF  
0
2.4k  
%
%
25k  
25k  
10k  
10k  
Va  
Va  
Vb  
Vb  
1.5 ms  
3 ms  
1M  
0.5M  
4 ms  
0.5M  
%
40 ms  
200 kHz  
TL/H/5689–3  
A1  
A2  
4
A3  
8
A10  
e b  
s
a
a
a
# # #  
V
V
REF  
OUT  
2
1024  
#
J
s
b
10V  
V
REF  
10V  
1023  
1024  
s
s
b
0
V
V
REF  
OUT  
e
where A  
1 if the A digital input is high  
N
N
e
A
N
0 if the A digital input is low  
N
FIGURE 3. Basic Connection: Unipolar or 2-Quadrant Multiplying  
Configuration (Digital Attenuator)  
http://www.national.com  
4
1234567...14

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