Datasheet > 电信电路 > ATM/SONET/SDH 集成电路> CY7B952-SXCT

CY7B952-SXCT

更新时间： 2024-02-10 00:35:13

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		/
页数	文件大小	规格书
9页	135K
描述
Transceiver, 1-Func, BICMOS, PDSO24, 0.300 INCH, MO-119, SOIC-24

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CY7B952-SXCT 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	SOP, SOP24,.4
针数：	24	Reach Compliance Code：	unknown
ECCN代码：	5A991.B.1	HTS代码：	8542.39.00.01
风险等级：	5.8	应用程序：	ATM;SDH;SONET
JESD-30 代码：	R-PDSO-G24	JESD-609代码：	e4
长度：	15.392 mm	湿度敏感等级：	3
功能数量：	1	端子数量：	24
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP24,.4	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	电源：	5 V
认证状态：	Not Qualified	座面最大高度：	2.667 mm
子类别：	ATM/SONET/SDH ICs	最大压摆率：	0.05 mA
标称供电电压：	5 V	表面贴装：	YES
技术：	BICMOS	电信集成电路类型：	ATM/SONET/SDH TRANSCEIVER
温度等级：	COMMERCIAL	端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	宽度：	7.5 mm
Base Number Matches：	1

CY7B952-SXCT 数据手册

CY7B952

SST™ SONET/SDH Serial Transceiver

• 100K ECL compatible I/O

Features

• No output clock “drift” without data transitions

• OC-3 Compliant with Bellcore and CCITT (ITU) specifi-

cations on:

• Link Status Indication

• Loop-back testing

• Single +5V supply

• 24-pin SOIC

— Jitter Generation (<0.01 UI)

— Jitter Transfer (<130 kHz)

— Jitter Tolerance

• SONET/SDH and ATM Compliant

• Compatiblewithfiber-opticmodules,coaxialcable,and

twisted pair media

• Compatible with IGT WAC013, IGT WAC413, and

PMC-Sierra PM5343

• Power-down options to minimize power or crosstalk

• Low operating current: <70 mA

• 0.8µ BiCMOS

• Clock and data recovery from 51.84- or 155.52-MHz

datastream

• 155.52-MHzclockmultiplicationfrom19.44-MHzsource

• 51.84-MHz clock multiplication from 6.48-MHz source

• ±1% frequency agility

Functional Description

The SONET/SDH Serial Transceiver (SST) is used in

SONET/SDH and ATM applications to recover clock and data

information from a 155.52-MHz or 51.84-MHz NRZ or NRZI

serial data stream and to provide differential data buffering for

the Transmit side of the system.

• Line Receiver Inputs: No external buffering required

• Differential output buffering

Logic Block Diagram

Pin Configuration

LOOP(t)

MODE

SOIC

Top View

FC+

FC–

FC+

RCLK–

RCLK+

FC–

RIN+

RIN–

RCLK+

RCLK–

RIN+

RIN–

RSER–

RSER+

LFI

PLL

RSER+

RSER–

MODE

CY7B952

LFI(t)

LOOP

REFCLK–

REFCLK+

TOUT–

RECEIVE

TCLK–

TCLK+

TSER+

TSER–

TRANSMIT

TOUT+

TOUT–

TSER+

TSER–

PLL

TCLK+

TCLK–

REFCLK+

REFCLK–

SST

Clock/Data

Recovery

SONET/SDH

S->P

P->S

Path

Transport

Overhead

Transceiver

Overhead

Line

Driver

Transceiver

Cypress

CY7B952

PMC-Sierra

PM5343STXC

PMC-Sierra

PM5344SPTX

Figure 1. SONET/SDH Overhead Processing Application

Cypress Semiconductor Corporation

Document #: 38-02018 Rev. *B

•

3901 North First Street

•

San Jose, CA 95134

•

408-943-2600

Revised April 27, 2004

12 3 4 5 6 7...9

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与CY7B952-SXCT相关器件

型号	品牌	描述	获取价格	数据表
CY7B9532V-ATC	CYPRESS	Transceiver, 1-Func, BICMOS, PQFP120, 14 X 14 MM, 1.40 MM HEIGHT, HEAT SINK, TQFP-120	获取价格
CY7B972NC	CYPRESS	Ethernet Transceiver, PQFP80,	获取价格
CY7B991	CYPRESS	Programmable Skew Clock Buffer	获取价格
CY7B991.2JC	CYPRESS	Programmable Skew Clock Buffer	获取价格
CY7B991.2JCT	CYPRESS	Programmable Skew Clock Buffer	获取价格
CY7B991.2JXC	CYPRESS	Programmable Skew Clock Buffer	获取价格

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