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CXD2598 PDF预览

CXD2598

更新时间： 2024-02-19 02:18:08
品牌 Logo 应用领域
索尼 - SONY 数字信号处理器
页数 文件大小 规格书
147页 1112K
描述
CD Digital Signal Processor with Built-in Digital Servo and DAC

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CXD2598 技术参数

生命周期：Obsolete零件包装代码：QFP
包装说明：QFP, QFP100,.7X.9针数：100
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.83Is Samacsys：N
商用集成电路类型：CONSUMER CIRCUITJESD-30 代码：R-PQFP-G100
长度：20 mm功能数量：1
端子数量：100最高工作温度：75 °C
最低工作温度：-20 °C封装主体材料：PLASTIC/EPOXY
封装代码：QFP封装等效代码：QFP100,.7X.9
封装形状：RECTANGULAR封装形式：FLATPACK
电源：5 V认证状态：Not Qualified
座面最大高度：3.1 mm子类别：Other Consumer ICs
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：2.7 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL EXTENDED端子形式：GULL WING
端子节距：0.65 mm端子位置：QUAD
宽度：14 mmBase Number Matches：1

CXD2598 数据手册

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CXD2598Q  
Pin  
No.  
Symbol  
I/O  
Description  
Spindle motor servo control output.  
35  
36  
37  
38  
39  
40  
41  
42  
43  
44  
45  
46  
47  
MDP  
O
I
1, Z, 0  
Disc innermost track detection signal input.  
Input/output of 2/3 frequency division for the XTAI pin.  
Sled drive output.  
SSTP  
FSTIO  
SFDR  
SRDR  
TFDR  
TRDR  
FFDR  
FRDR  
VDD  
I/O  
O
O
O
O
O
O
—
—
I
1, 0  
1, 0  
1, 0  
1, 0  
1, 0  
1, 0  
1, 0  
—
Sled drive output.  
Tracking drive output.  
Tracking drive output.  
Focus drive output.  
Focus drive output.  
Digital power supply.  
Digital GND.  
VSS  
—
Test pin. Normally, GND.  
Test pin. Normally, GND.  
TEST  
TES1  
I
Crystal selection input. Low when the crystal is 16.9344MHz; high when the  
crystal is 33.8688MHz.  
48  
XTSL  
I
49  
50  
51  
52  
53  
54  
55  
56  
57  
58  
59  
60  
61  
62  
63  
64  
65  
66  
67  
68  
69  
VC  
I
I
Center voltage input.  
Focus error signal input.  
FE  
Sled error signal input.  
SE  
I
Tracking error signal input.  
Center servo analog input.  
RF signal input.  
TE  
I
CE  
I
RFDC  
ADIO  
AVSS0  
IGEN  
AVDD0  
ASYO  
ASYI  
RFAC  
AVSS3  
CLTV  
FILO  
FILI  
I
Test pin. Do not connect anything.  
Analog GND.  
O
—
I
Analog  
—
Operational amplifier constant current input.  
Analog power supply.  
—
O
I
—
EFM full-swing output (low = VSS, high = VDD).  
Asymmetry comparator voltage input.  
EFM signal input.  
1, 0  
I
Analog GND.  
—
I
—
Multiplier VCO1 control voltage input.  
Master PLL filter output (slave = digital PLL).  
Master PLL filter input.  
O
I
Analog  
Master PLL charge pump output.  
Analog power supply.  
PCO  
AVDD3  
BIAS  
VCTL  
O
—
I
1, Z, 0  
—
Asymmetry circuit constant current input.  
Wide-band EFM PLL VCO2 control voltage input.  
– 5 –  
I
12345678...147

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