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Datasheet > 可编程逻辑 > 可编程逻辑器件> ATF16V8C-7JC
ATF16V8C-7JC PDF预览

ATF16V8C-7JC

更新时间： 2024-01-03 20:30:21
品牌 Logo 应用领域
爱特美尔 - ATMEL 可编程逻辑器件输入元件异步传输模式PCATM时钟
页数 文件大小 规格书
16页 549K
描述
High Performance E2 PLD

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ATF16V8C-7JC 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：TSSOP包装说明：4.40 MM, PLASTIC, MO-153AC, TSSOP-20
针数：20Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.77
其他特性：8 MACROCELLS架构：PAL-TYPE
最大时钟频率：100 MHzJESD-30 代码：R-PDSO-G20
JESD-609代码：e0长度：6.5 mm
湿度敏感等级：2专用输入次数：7
I/O 线路数量：8输入次数：18
输出次数：8产品条款数：64
端子数量：20最高工作温度：85 °C
最低工作温度：-40 °C组织：7 DEDICATED INPUTS, 8 I/O
输出函数：MACROCELL封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP20,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：240电源：5 V
可编程逻辑类型：FLASH PLD传播延迟：7.5 ns
认证状态：Not Qualified座面最大高度：1.2 mm
子类别：Programmable Logic Devices最大供电电压：5.25 V
最小供电电压：4.75 V标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：4.4 mmBase Number Matches：1

ATF16V8C-7JC 数据手册

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AC Characteristics  
-5  
-7  
Symbol Parameter  
Min  
1
Max  
5
Min  
3
Max  
7.5  
Units  
Input or Feedback to Non-Registered  
t
ns  
PD  
Output  
t
t
t
t
t
t
Clock to Feedback  
Clock to Output  
Input or Feedback Setup Time  
Input Hold Time  
Clock Period  
3
4
3
5
ns  
ns  
CF  
CO  
S
1
3
0
6
3
2
5
0
8
4
ns  
ns  
H
ns  
P
Clock Width  
ns  
W
External Feedback 1/(t + t  
)
142  
166  
166  
100  
125  
125  
MHz  
MHz  
MHz  
S
CO  
F
MAX  
Internal Feedback 1/(t + t  
)
S
CF  
No Feedback 1/(t )  
P
Input to Output Enable —  
Product Term  
t
t
2
2
6
5
3
2
9
9
ns  
ns  
EA  
Input to Output Disable —  
Product Term  
ER  
t
t
OE pin to Output Enable  
OE pin to Output Disable  
2
5
5
2
6
6
ns  
ns  
PZX  
1.5  
1.5  
PXZ  
Power Down AC Characteristics (1, 2, 3)  
-5  
-7  
Symbol Parameter  
Min  
5
Max  
Min  
7.5  
0
Max  
Units  
ns  
t
t
t
t
t
t
t
t
t
t
Valid Input Before PD High  
Valid OE Before PD High  
Valid Clock Before PD High  
Input Don’t Care After PD High  
OE Don’t Care After PD High  
Clock Don’t Care After PD High  
PD Low to Valid Input  
IVDH  
0
ns  
GVDH  
CVDH  
DHIX  
0
0
ns  
5
5
7.5  
7.5  
7.5  
7.5  
20  
ns  
ns  
DHGX  
DHCX  
DLIV  
5
ns  
5
ns  
PD Low to Valid OE  
15  
15  
20  
ns  
DLGV  
DLCV  
DLOV  
PD Low to Valid Clock  
20  
ns  
PD Low to Valid Output  
25  
ns  
Notes: 1. Output data is latched and held.  
2. HI-Z outputs remain HI-Z.  
3. Clock and input transitions are ignored.  
4
ATF16V8C  
1234567...16

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