AS7C4096A-20JC

更新时间： 2024-01-05 15:50:11

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ALSC		静态存储器
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10页	325K
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5.0V 512K x 8 CMOS SRAM

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AS7C4096A-20JC 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	TSOP2
包装说明：	TSOP2, TSOP44,.46,32	针数：	44
Reach Compliance Code：	compliant	ECCN代码：	3A991.B.2.A
HTS代码：	8542.32.00.41	Factory Lead Time：	8 weeks
风险等级：	5.41	Is Samacsys：	N
最长访问时间：	20 ns	I/O 类型：	COMMON
JESD-30 代码：	R-PDSO-G44	JESD-609代码：	e3/e6
长度：	18.415 mm	内存密度：	4194304 bit
内存集成电路类型：	STANDARD SRAM	内存宽度：	8
湿度敏感等级：	3	功能数量：	1
端子数量：	44	字数：	524288 words
字数代码：	512000	工作模式：	ASYNCHRONOUS
最高工作温度：	85 °C	最低工作温度：	-40 °C
组织：	512KX8	输出特性：	3-STATE
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSOP2
封装等效代码：	TSOP44,.46,32	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE	并行/串行：	PARALLEL
峰值回流温度（摄氏度）：	260	电源：	5 V
认证状态：	Not Qualified	座面最大高度：	1.2 mm
最大待机电流：	0.01 A	最小待机电流：	4.5 V
子类别：	SRAMs	最大压摆率：	0.1 mA
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	MATTE TIN/TIN BISMUTH	端子形式：	GULL WING
端子节距：	0.8 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	40	宽度：	10.16 mm
Base Number Matches：	1

AS7C4096A-20JC 数据手册

AS7C4096A

Write waveform 2 (CE controlled)⁹

t_WC

t_WR

t_AH

t_AW

Address

t_AS

t_CW

t_WP

D_IN

t_DW

Data valid

t_DH

AC test conditions

- Output load: see Figure B.

- Input pulse level: GND to V - 0.5V. See Figures A and B.

- Input rise and fall times: 2 ns. See Figure A.

- Input and output timing reference levels: 1.5V.

+5.0V

Thevenin equivalent:

168

480Ω

Ω

- 0.5V

GND

D_OUT

255

90%

10%

90%

10%

+1.728V

D_OUT

Ω

C¹⁰

2 ns

Figure A: Input pulse

GND

Figure B: 5.0V Output load

Notes

During V_CCpower-up, a pull-up resistor to V_CCon CE is required to meet I_SBspecification.

For test conditions, see AC Test Conditions.

t_CLZand t_CHZare specified with C_L= 5pF as in Figure B. Transition is measured ±500 mV from steady-state voltage.

This parameter is guaranteed, but not tested.

WE is HIGH for read cycle.

CE and OE are LOW for read cycle.

Address valid prior to or coincident with CE transition Low.

All read cycle timings are referenced from the last valid address to the first transitioning address.

All write cycle timings are referenced from the last valid address to the first transitioning address.

10 C = 30pF, except at high Z and low Z parameters, where C = 5pF.

5/27/05, v. 1.1

Alliance Semiconductor

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