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ADUM1210

更新时间： 2024-01-11 02:21:18

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Dual-Channel Digital Isolator

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ADUM1210 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SOIC
包装说明：	SOP,	针数：	8
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	1.4
Is Samacsys：	N	接口集成电路类型：	INTERFACE CIRCUIT
JESD-30 代码：	R-PDSO-G8	JESD-609代码：	e3
长度：	4.9 mm	湿度敏感等级：	1
功能数量：	1	端子数量：	8
最高工作温度：	105 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	260	认证状态：	Not Qualified
座面最大高度：	1.75 mm	最大供电电压：	5.5 V
最小供电电压：	4.5 V	标称供电电压：	5 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	3.9 mm
Base Number Matches：	1

ADUM1210 数据手册

ADuM1210

ELECTRICAL CHARACTERISTICS—MIXED 5 V/3 V OR 3 V/5 V OPERATION

5 V/3 V operation: 4.5 V ≤ V_DD1≤ 5.5 V, 2.7 V ≤ V_DD2≤ 3.6 V. 3 V/5 V operation: 2.7 V ≤ V_DD1≤ 3.6 V, 4.5 V ≤ V_DD2≤ 5.5 V. All

minimum/maximum specifications apply over the entire recommended operating range, unless otherwise noted. All typical specifications

are at T_A= 25°C; V_DD1= 3.0 V, V_DD2= 5.0 V; or V_DD1= 5.0 V, V_DD2= 3.0 V. All voltages are relative to their respective ground.

Table 3.

Parameter

Symbol

Min

Typ

Max

Unit

Test Conditions

DC SPECIFICATIONS

Input Supply Current, per Channel,

Quiescent

I_{DDI (Q)}

5 V/3 V Operation

3 V/5 V Operation

Output Supply Current, per Channel,

Quiescent

0.50

0.26

0.6

0.35

I_{DDO (Q)}

5 V/3 V Operation

3 V/5 V Operation

0.11

0.19

0.20

0.25

Total Supply Current, Two Channels¹

DC to 2 Mbps

V_DD1Supply Current

5 V/3 V Operation

3 V/5 V Operation

I_{DD1 (Q)}

1.1

0.6

1.4

1.0

DC to 1 MHz logic signal frequency

V_DD2Supply Current

5 V/3 V Operation

3 V/5 V Operation

I_{DD2 (Q)}

0.2

0.5

0.6

0.8

DC to 1 MHz logic signal frequency

10 Mbps

V_DD1Supply Current

5 V/3 V Operation

3 V/5 V Operation

I_{DD1 (10)}

4.3

2.2

5.5

3.4

5 MHz logic signal frequency

V_DD2Supply Current

5 V/3 V Operation

3 V/5 V Operation

I_{DD2 (10)}

0.7

1.3

+0.01

1.1

2.0

+10

μA

5 MHz logic signal frequency

0 V ≤ V_IA, V_IB≤ V_DD1

Input Currents

I_IA, I_IB

V_IH

V_IL

−10

0.7 × V_DD1

Logic High Input Threshold

Logic Low Input Threshold

Logic High Output Voltages

0.3 × V_DD1

V_OAH, V_OBHV_DD2− 0.1 V_DD2

I_Ox= −20 μA, V_Ix= V_IxH

I_Ox= −4 mA, V_Ix= V_IxH

I_Ox= 20 μA, V_Ix= V_IxL

I_Ox= 400 μA, V_Ix= V_IxL

I_Ox= 4 mA, V_Ix= V_IxL

V_DD2− 0.5

V_DD2− 0.2

0.0

0.04

0.2

Logic Low Output Voltages

V_OAL, V_OBL

0.1

0.4

SWITCHING SPECIFICATIONS

Minimum Pulse Width²

Maximum Data Rate³

100

Mbps

ps/°C

C_L= 15 pF, CMOS signal levels

Propagation Delay⁴

t_PHL, t_PLH

PWD

Pulse Width Distortion, |t_PLH− t_PHL

Change vs. Temperature

Propagation Delay Skew⁵

Channel-to-Channel Matching,

Codirectional Channels⁶

t_PSK

t_PSKCD

Channel-to-Channel Matching,

t_PSKOD

t_R/t_F

C_L= 15 pF, CMOS signal levels

Opposing-Directional Channels⁶

Output Rise/Fall Time (10% to 90%)

5 V/3 V Operation

3.0

2.5

3 V/5 V Operation

Rev. C | Page 7 of 20

1...4 5 678 9 10...20

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