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ADSP-21371KSZ-ENG

更新时间： 2024-02-03 19:45:43
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
48页 1996K
描述
SHARC Processor

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ADSP-21371KSZ-ENG 技术参数

生命周期：Obsolete零件包装代码：QFP
包装说明：LEAD FREE, MQFP-208针数：208
Reach Compliance Code：unknownECCN代码：3A991.A.2
HTS代码：8542.31.00.01风险等级：5.84
地址总线宽度：24桶式移位器：YES
边界扫描：YES最大时钟频率：133 MHz
外部数据总线宽度：32格式：FLOATING POINT
内部总线架构：MULTIPLEJESD-30 代码：S-PQFP-G208
JESD-609代码：e3长度：28 mm
低功率模式：YES端子数量：208
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：FQFP
封装形状：SQUARE封装形式：FLATPACK, FINE PITCH
认证状态：Not Qualified座面最大高度：4.1 mm
最大供电电压：1.26 V最小供电电压：1.14 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：TIN
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD宽度：28 mm
uPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHER

ADSP-21371KSZ-ENG 数据手册

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SHARC® Processor  
ADSP-21371  
a
Preliminary Technical Data  
SUMMARY  
High performance 32-bit/40-bit floating point processor  
optimized for high performance audio processing  
Single-instruction, multiple-data (SIMD) computational  
architecture  
On-chip memory—1M bit of on-chip SRAM and a dedicated  
4M bit of on-chip mask-programmable ROM  
Code compatible with all other members of the SHARC family  
The ADSP-21371 is available with a 266 MHz core instruction  
rate with unique audio centric peripherals such as the digi-  
tal applications interface, serial ports, precision clock  
generators and more. For complete ordering information,  
see Ordering Guide on Page 47  
CORE PROCESSOR  
INSTRUCTION  
4 BLOCKS OF  
ON-CHIP MEMORY  
JTAG TEST & EMULATION  
PWM  
CACHE  
TI MER  
32 X 48-BI T  
1M BIT RAM, 4M BIT ROM  
DAG2  
8X4X32  
ADDR  
32  
DATA  
64  
DAG1  
8X4X32  
PROGRAM  
SEQUENCER  
FLAGS  
4-15  
32  
EXTERNAL PORT  
7
DATA  
P M ADDRE SS BUS  
DM ADDRES S BUS  
32  
SDRAM  
CONTROLLER  
11  
32  
3
ASYNCHRONOUS  
MEMO RY  
INTERFACE  
CONTROL  
24  
64  
64  
PM DATA BUS  
IOA(24)  
IOD(32)  
ADDRESS  
DM DATA BUS  
PROCESSING  
ELEMENT  
(P EX)  
PX REGISTER  
DMA CONTROLLER  
(32 CHANNELS)  
PROCESSING  
ELEMENT  
(P EY)  
IOP REGISTER (MEMORY MAPPED)  
CONTROL, STATUS, & DATA BUFFERS  
SERIAL PORTS (8)  
SPI PORT (2)  
4
PRECISION CLOCK  
GENERATORS (4)  
UART (1)  
GPIO FLAGS/  
IRQ/TIMEXP  
INPUT DATA PORT/  
PDAP  
TWO WIRE  
INTERFACE  
SPDIF (Rx/Tx)  
TIMERS (2)  
DAI PINS  
DPI PINS  
S
DIGITAL PERIP HERAL INTE RFACE  
DIGITAL APPLICATIONS INTERFACE  
I/O PROCESSOR  
14  
20  
Figure 1. Functional Block Diagram  
SHARC and the SHARC logo are registered trademarks of Analog Devices, Inc.  
Rev. PrA  
Information furnished by Analog Devices is believed to be accurate and reliable.  
However, no responsibility is assumed by Analog Devices for its use, nor for any  
infringements of patents or other rights of third parties that may result from its use.  
Specifications subject to change without notice. No license is granted by implication  
or otherwise under any patent or patent rights of Analog Devices. Trademarks and  
registered trademarks are the property of their respective companies.  
One Technology Way, P.O. Box 9106, Norwood, MA 02062-9106 U.S.A.  
Tel: 781.329.4700  
Fax: 781.326.8703  
www.analog.com  
©2006 Analog Devices, Inc. All rights reserved.  
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