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ADMC331-ADVEVALKIT

更新时间： 2024-02-02 01:24:49
品牌 Logo 应用领域
亚德诺 - ADI 电机控制器
页数 文件大小 规格书
36页 247K
描述
Single Chip DSP Motor Controller

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ADMC331-ADVEVALKIT 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：PLASTIC, TQFP-80
针数：80Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.31.00.01
风险等级：5.89地址总线宽度：
桶式移位器：YES边界扫描：NO
最大时钟频率：16.384 MHz外部数据总线宽度：
格式：FIXED POINT内部总线架构：MULTIPLE
JESD-30 代码：S-PQFP-G80JESD-609代码：e0
长度：14 mm低功率模式：YES
端子数量：80最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：LQFP封装形状：SQUARE
封装形式：FLATPACK, LOW PROFILE峰值回流温度（摄氏度）：220
认证状态：Not Qualified座面最大高度：1.6 mm
最大供电电压：5.5 V最小供电电压：4.5 V
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：TIN LEAD端子形式：GULL WING
端子节距：0.65 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：14 mm
uPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHERBase Number Matches：1

ADMC331-ADVEVALKIT 数据手册

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(V = +5 V ꢁ 10%, GND = SGND = 0 V, T = –40ꢂC to +85ꢂC, unless otherwise noted)  
ADMC331–SPECIFICATIONS  
DD  
A
Parameter  
Min  
Typ Max  
Units  
Conditions/Comments  
ANALOG-TO-DIGITAL CONVERTER  
Charging Capacitor = 1000 pF  
2.5 kHz Sample Frequency  
Signal Input  
Resolution  
Converter Linearity  
Zero Offset  
Channel-to-Channel Comparator Match  
Comparator Delay  
Current Source  
0.3  
3.31  
122  
12  
50  
22  
V
Bits  
LSBs  
mV  
mV  
ns  
µA  
%
No Missing Codes  
2
5
600  
10.16  
2
12.7 15.24  
2
Current Source Linearity  
ELECTRICAL CHARACTERISTICS  
VIL  
Logic Low  
0.8  
V
V
VIH Logic High  
VOL Low Level Output Voltage  
VOL Low Level Output Voltage (XTAL)  
VOH High Level Output Voltage  
0.4  
0.5  
V
V
V
IOL = 2 mA  
IOL = 2 mA  
IOH = 0.5 mA  
4
IIL  
Low Level Input Current  
High Level Input Current  
Hi-Level PWMTRIP, PIO0–PIO23 Current  
Hi-Level PWMPOL/PWMSR Current  
Lo-Level PWMTRIP, PIO0–PIO23 Current  
Lo-Level PWMPOL/PWMSR Current  
Supply Current (Dynamic)  
–10  
µA  
µA  
µA  
µA  
µA  
µA  
mA  
mA  
VIN = 0 V  
VIN = VDD  
IIH  
IIH  
IIH  
IIL  
IIL  
IDD  
IDD  
10  
100  
10  
@ VDD = max, VIN = VDD max  
@ VDD = max, VIN = VDD max  
@ VDD = max, VIN = 0 V  
@ VDD = max, VIN = 0 V  
13 MHz DSP Clock  
13 MHz DSP Clock  
10  
100  
120  
60  
Supply Current (Idle)  
REFERENCE VOLTAGE OUTPUT  
Voltage Level  
Output Voltage Change TMIN to TMAX  
2.2  
2.55 2.9  
20  
V
mV  
100 µA Load  
16-BIT PWM TIMER  
Counter Resolution  
16  
76.9  
38.5  
78  
Bits  
ns  
ns  
µs  
ns  
µs  
ns  
kHz  
Edge Resolution (Single Update Mode)  
Edge Resolution (Double Update Mode)  
Programmable Deadtime Range  
Programmable Deadtime Increments  
Programmable Pulse Deletion Range  
Programmable Pulse Deletion Increments  
PWM Frequency Range  
13 MHz CLKIN  
13 MHz CLKIN  
13 MHz CLKIN  
13 MHz CLKIN  
13 MHz CLKIN  
13 MHz CLKIN  
13 MHz CLKIN  
13 MHz CLKIN  
13 MHz CLKIN  
0
0
76.9  
78  
76.9  
0.198  
0.077  
0.02  
PWMSYNC Pulsewidth (TCRST  
Gate Drive Chop Frequency Range  
)
9.8  
6.5  
µs  
MHz  
AUXILIARY PWM TIMERS  
Resolution  
8
Bits  
PWM Frequency  
0.051  
6.5  
MHz  
13 MHz CLKIN  
NOTES  
1Signal input max V = 3.5 V if VDD = 5 V 5%.  
2Resolution varies with PWM switching frequency (13 MHz Clock in Double Update mode), 50.7 kHz = 9 bits, 6.3 kHz = 12 bits.  
Specifications subject to change without notice.  
–2–  
REV. B  
1234567...36

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