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ADF4153ABCPZ-RL7

更新时间： 2024-01-30 04:51:40

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亚德诺 - ADI		信息通信管理
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描述
Fractional-N Frequency Synthesizer

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ADF4153ABCPZ-RL7 技术参数

Source Url Status Check Date：	2013-05-01 14:56:35.649	是否无铅：	含铅
是否Rohs认证：	符合	生命周期：	Active
包装说明：	QCCN, LCC20,.16SQ,20	针数：	20
Reach Compliance Code：	compliant	ECCN代码：	5A991.B
HTS代码：	8542.39.00.01	风险等级：	5.8
模拟集成电路 - 其他类型：	PLL FREQUENCY SYNTHESIZER	JESD-30 代码：	S-PQCC-N20
端子数量：	20	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	QCCN	封装等效代码：	LCC20,.16SQ,20
封装形状：	SQUARE	封装形式：	CHIP CARRIER
电源：	3,3/5 V	认证状态：	Not Qualified
子类别：	PLL or Frequency Synthesis Circuits	最大供电电流 (Isup)：	24 mA
表面贴装：	YES	技术：	BICMOS
温度等级：	INDUSTRIAL	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD

ADF4153ABCPZ-RL7 数据手册

ADF4153A

Data Sheet

TIMING SPECIFICATIONS

AV_DD= DV_DD= SDV_DD= 2.7 V to 3.3 V; V_P= AV_DDto 5.5 V; AGND = DGND = 0 V; T_A= T_MINto T_MAX, unless otherwise noted;

dBm referred to 50 Ω.

Table 2.

Parameter

Limit at T_MINto T_MAX

Unit

Test Conditions/Comments

LE setup time

DATA to CLK setup time

DATA to CLK hold time

CLK high duration

CLK low duration

t₁

t₂

t₃

t₄

t₅

t₆

t₇

ns min

CLK to LE setup time

LE pulse width

t₄

t₅

CLK

t₂

t₃

DB1

(CONTROL BIT C2)

DB0 (LSB)

(CONTROL BIT C1)

DB23 (MSB)

DB22

DB2

DATA

t₇

t₁

t₆

Figure 2. Timing Diagram

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