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Datasheet > 消费电路 > 其他商用集成电路> ADAU1442YSVZ-3A-RL
ADAU1442YSVZ-3A-RL PDF预览

ADAU1442YSVZ-3A-RL

更新时间： 2024-02-14 02:35:58
品牌 Logo 应用领域
亚德诺 - ADI 消费电路商用集成电路
页数 文件大小 规格书
92页 1008K
描述
SigmaDSP Digital Audio Processor

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ADAU1442YSVZ-3A-RL 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFP
包装说明：HTFQFP, TQFP100,.63SQ针数：100
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.31.00.01风险等级：2.17
Is Samacsys：N其他特性：IT CAN OPERATES WITH 3.3V ANALOG SUPPLY AND 1.8V DIGITAL SUPPLY
商用集成电路类型：CONSUMER CIRCUITJESD-30 代码：S-PQFP-G100
长度：14 mm湿度敏感等级：3
功能数量：1端子数量：100
最高工作温度：105 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：HTFQFP
封装等效代码：TQFP100,.63SQ封装形状：SQUARE
封装形式：FLATPACK, HEAT SINK/SLUG, THIN PROFILE, FINE PITCH峰值回流温度（摄氏度）：260
电源：1.8,3.3 V认证状态：Not Qualified
座面最大高度：1.2 mm子类别：Other Consumer ICs
最大供电电压 (Vsup)：3.63 V最小供电电压 (Vsup)：2.97 V
表面贴装：YES温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：14 mmBase Number Matches：1

ADAU1442YSVZ-3A-RL 数据手册

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ADAU1442/ADAU1445/ADAU1446  
Parameter  
Min  
Typ  
−133  
40  
Max  
Unit Test Conditions/Comments  
I/O Sample Rate Ratio  
THD + N  
1:8  
7.75:1  
−120  
dB  
CRYSTAL OSCILLATOR  
Transconductance  
REGULATOR2  
mS  
DVDD Voltage  
1.65  
1.75  
1.85  
V
Maximum 500 mA load.  
1 To calculate the group delay, refer to the SRC Group Delay section.  
2 Regulator specifications are calculated using an NJT4030P transistor from On Semiconductor in the circuit.  
AVDD = 3.3 V 10%, DVDD = 1.8 V 10%, PVDD = 3.3 V, IOVDD = 3.3 V 10%, TA = −40°C to +105°C, master clock input = 12.288 MHz,  
core clock fCORE = 172.032 MHz, I/O pins set to 2 mA drive setting, unless otherwise noted.  
Table 3.  
Parameter  
Min  
Typ  
Max  
Unit Test Conditions/Comments  
ANALOG PERFORMANCE  
Auxiliary Analog Inputs  
Resolution  
AVDD = 3.3 V 10%.  
10  
AVDD  
Bits  
V
LSB  
LSB  
LSB  
kΩ  
Full-Scale Analog Input  
Integral Nonlinearity (INL)  
Differential Nonlinearity (DNL)  
Gain Error  
Input Impedance  
Sample Rate  
−2.3  
−2.0  
−2.0  
+2.3  
+2.0  
+2.0  
200  
fCORE/896  
kHz  
4:1 multiplexed input, each  
channel at fCORE/3584. For  
fCORE = 172.032 MHz, each  
channel is sampled at 48 kHz.  
DIGITAL I/O  
Input Voltage, High (VIH)  
0.7 × IOVDD  
−2  
V
Digital input pins except  
SPDIFI.1  
Digital input pins except  
SPDIFI.1  
Digital input pins except  
MCLK and SPDIFI.  
Input Voltage, Low (VIL)  
0.3 × IOVDD  
+2  
V
Input Leakage, High (IIH) at 3.3 V  
μA  
−2  
60  
−85  
−2  
+8  
μA  
μA  
μA  
μA  
MCLK.  
SPDIFI.  
All other pins.  
CLKMODEx, RSVD, PLLx,  
RESET.  
140  
−10  
+2  
Input Leakage, Low (IIL) at 0 V  
−8  
−140  
0.85 × IOVDD  
+2  
−60  
μA  
μA  
V
V
pF  
mA  
MCLK.  
SPDIFI.  
High Level Output Voltage (VOH)  
Low Level Output Voltage (VOL)  
Input Capacitance (CI)  
IOH = 1 mA.  
IOL = 1 mA.  
Guaranteed by design.  
These pins are not designed  
for static current draw and  
should not drive LEDs directly.  
0.1 × IOVDD  
5
2
Multipurpose Pins Output Drive  
POWER  
Supply Voltage  
Analog Voltage (AVDD)  
Digital Voltage (DVDD)  
PLL Voltage (PVDD)  
IOVDD Voltage (IOVDD)  
Supply Current  
2.97  
1.62  
2.97  
2.97  
3.3  
1.8  
3.3  
3.3  
3.63  
1.98  
3.63  
3.63  
V
V
V
V
Analog Current (AVDD)  
2
mA  
Rev. C | Page 6 of 92  
1...3456789...92

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