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AD736JRZ-RL

更新时间： 2024-01-24 03:53:13

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亚德诺 - ADI		转换器模拟特殊功能转换器光电二极管
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8页	220K
描述
Low Cost, Low Power, True RMS-to-DC Converter

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AD736JRZ-RL 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Not Recommended	零件包装代码：	SOIC
包装说明：	SOP, SOP8,.25	针数：	8
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.07
转换器类型：	RMS TO DC CONVERTER	JESD-30 代码：	R-PDSO-G8
JESD-609代码：	e3	长度：	4.9 mm
最大线性误差 (EL)：	0.35%	湿度敏感等级：	1
最大负电源电压：	-16.5 V	最小负电源电压：	-3.2 V
标称负供电电压：	-5 V	功能数量：	1
端子数量：	8	最大工作频率：	0.005 MHz
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP8,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
最大正输入电压：	1 V	电源：	+-5 V
认证状态：	Not Qualified	座面最大高度：	1.75 mm
子类别：	Analog Special Function Converters	最大压摆率：	0.27 mA
最大供电电压：	16.5 V	最小供电电压：	2.8 V
标称供电电压：	5 V	表面贴装：	YES
技术：	BIPOLAR	温度等级：	COMMERCIAL
端子面层：	Matte Tin (Sn)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	最大总误差：	2%
宽度：	3.9 mm	Base Number Matches：	1

AD736JRZ-RL 数据手册

Typical Characteristics–

AD736

Figure 10. Error vs. RMS Input

Voltage (Pin 2), Output Buffer Off-

set Is Adjusted To Zero

Figure 11. C_AVvs. Frequency for

Specified Averaging Error

Figure 12. RMS Input Level vs.

Frequency for Specified Averag-

ing Error

Figure 14. Settling Tim e vs. RMS

Input Level for Various

Values of C_AV

Figure 15. Pin 2 Input Bias Cur-

rent vs. Tem perature

Figure 13. Pin 2 Input Bias Current

vs. Supply Voltage

CALCULATING SETTLING TIME USING FIGURE 14

T he graph of Figure 14 may be used to closely approximate the

time required for the AD736 to settle when its input level is re-

duced in amplitude. T he net time required for the rms converter

to settle will be the difference between two times extracted from

the graph – the initial time minus the final settling time. As an

example, consider the following conditions: a 33 µF averaging

capacitor, an initial rms input level of 100 mV and a final (re-

duced) input level of 1 mV. From Figure 14, the initial settling

time (where the 100 mV line intersects the 33 µF line) is around

80 ms.

T he settling time corresponding to the new or final input level

of 1 mV is approximately 8 seconds. T herefore, the net time for

the circuit to settle to its new value will be 8 seconds minus

80 ms which is 7.92 seconds. Note that, because of the smooth

decay characteristic inherent with a capacitor/diode combina-

tion, this is the total settling time to the final value (i.e., not the

settling time to 1%, 0.1%, etc., of final value). Also, this graph

provides the worst case settling time, since the AD736 will settle

very quickly with increasing input levels.

REV. C

–5–

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