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Datasheet > 电信电路 > 其他电信集成电路> AD73311ARSZ-REEL
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AD73311ARSZ-REEL

更新时间： 2024-01-03 20:46:21
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
36页 333K
描述
Single-Channel, 3 V and 5 V Front-End Processor for General Purpose Applications Including Speech and Telephony

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AD73311ARSZ-REEL 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP, SOP20,.4针数：20
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.07
JESD-30 代码：R-PDSO-G20JESD-609代码：e3
长度：12.8 mm湿度敏感等级：1
功能数量：1端子数量：20
最高工作温度：105 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP20,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
电源：3 V认证状态：Not Qualified
座面最大高度：2.65 mm子类别：Modems
最大压摆率：0.0125 mA标称供电电压：3 V
表面贴装：YES技术：CMOS
电信集成电路类型：TELECOM CIRCUIT温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40宽度：7.5 mm
Base Number Matches：1

AD73311ARSZ-REEL 数据手册

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(AVDD = +3 V ؎ 10%; DVDD = +3 V ؎ 10%; DGND = AGND = 0 V, fMCLK = 16.384 MHz,  
AD73311–SPECIFICATIONS1 FS = 64 kHz; TA = TMIN to TMAX, unless otherwise noted)  
AD73311A  
Typ  
Parameter  
Min  
Max  
Unit  
Test Conditions/Comments  
REFERENCE  
REFCAP  
5VEN = 0  
Absolute Voltage, VREFCAP  
REFCAP TC  
REFOUT  
1.08  
1.2  
50  
1.32  
V
ppm/°C  
0.1 µF Capacitor Required from  
REFCAP to AGND2  
Typical Output Impedance  
Absolute Voltage, VREFOUT  
Minimum Load Resistance  
Maximum Load Capacitance  
68  
1.2  
Ω
1.08  
1
1.32  
100  
V
Unloaded  
kΩ  
pF  
ADC SPECIFICATIONS  
Maximum Input Range at VIN2, 3  
1.578  
–2.85  
V p-p  
dBm  
V p-p  
dBm  
5VEN = 0, Measured Differentially  
5VEN = 0, Measured Differentially  
Nominal Reference Level at VIN  
(0 dBm0)  
1.0954  
–6.02  
Absolute Gain  
PGA = 0 dB  
PGA = 38 dB  
Gain Tracking Error  
Signal to (Noise + Distortion)  
PGA = 0 dB  
–0.75  
–1.5  
0.1  
–0.5  
0.1  
+1.0  
+0.5  
dB  
dB  
dB  
1.0 kHz, 0 dBm0  
1.0 kHz, 0 dBm0  
1.0 kHz, +3 dBm0 to –50 dBm0  
Refer to Figure 5  
300 Hz to 3.4 kHz Frequency Range  
0 Hz to 32 kHz Frequency Range  
300 Hz to 3.4 kHz Frequency Range  
0 Hz to 32 kHz Frequency Range  
70  
55  
61  
53  
76  
56  
65  
54  
dB  
dB  
dB  
dB  
PGA = 38 dB  
Total Harmonic Distortion  
PGA = 0 dB  
PGA = 38 dB  
Intermodulation Distortion  
Idle Channel Noise  
Crosstalk  
–83  
–83  
–78  
–76  
–100  
–70  
–70  
dB  
dB  
dB  
dBm0  
PGA = 0 dB  
PGA = 0 dB  
ADC Input Signal Level: 1.0 kHz, 0 dBm0  
DAC Input at Idle  
dB  
DC Offset  
Power Supply Rejection  
–20  
+15  
–55  
+50  
mV  
dB  
PGA = 0 dB  
Input Signal Level at AVDD and DVDD  
Pins 1.0 kHz, 100 mV p-p Sine Wave  
64 kHz Output Sample Rate  
DMCLK = 16.384 MHz  
Group Delay4, 5  
25  
25  
µs  
Input Resistance at VIN2, 4  
kΩ6  
DAC SPECIFICATIONS  
Maximum Voltage Output Swing2  
Single Ended  
1.578  
–2.85  
3.156  
3.17  
V p-p  
dBm  
V p-p  
dBm  
5VEN = 0, PGA = 6 dB  
5VEN = 0, PGA = 6 dB  
Differential  
Nominal Voltage Output Swing (0 dBm0)  
Single-Ended  
1.0954  
–6.02  
2.1909  
0
1.2  
+0.2  
0.1  
V p-p  
dBm  
V p-p  
dBm  
V
dB  
dB  
5VEN = 0, PGA = 6 dB  
5VEN = 0, PGA = 6 dB  
Differential  
Output Bias Voltage  
Absolute Gain  
Gain Tracking Error  
Signal to (Noise + Distortion)  
PGA = 0 dB  
1.08  
–0.75  
1.32  
+1.0  
5VEN = 0, REFOUT Unloaded  
1.0 kHz, 0 dBm0  
1.0 kHz, +3 dBm0 to –50 dBm0  
AVDD = +3 V 5%; Refer to Figure 5  
300 Hz to 3.4 kHz Frequency Range  
0 Hz to 32 kHz Frequency Range  
300 Hz to 3.4 kHz Frequency Range  
0 Hz to 32 kHz Frequency Range  
AVDD = +3 V 5%  
62.5  
62.5  
70  
62.5  
71  
dB  
dB  
dB  
dB  
PGA = 6 dB  
62.5  
Total Harmonic Distortion  
PGA = 0 dB  
PGA = 6 dB  
Intermodulation Distortion  
Idle Channel Noise  
Crosstalk  
–70  
–70  
–68  
–82  
–100  
–62.5  
–62.5  
dB  
dB  
dB  
dBm0  
PGA = 0 dB  
PGA = 0 dB  
ADC Input Signal Level: AGND; DAC  
Output Signal Level: 1.0 kHz, 0 dBm0  
dB  
REV. B  
–2–  
1234567...36

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