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A8287SLB

更新时间： 2024-02-03 02:15:18
品牌 Logo 应用领域
急速微 - ALLEGRO 稳压器模拟IC信号电路光电二极管
页数 文件大小 规格书
17页 526K
描述
LNB Supply and Control Voltage Regulator

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A8287SLB 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：BATWING, LEAD FREE, PLASTIC, SOIC-24针数：24
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.83模拟集成电路 - 其他类型：ANALOG CIRCUIT
JESD-30 代码：R-PDSO-G24JESD-609代码：e3
长度：15.29 mm湿度敏感等级：3
功能数量：1端子数量：24
最高工作温度：85 °C最低工作温度：-20 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP24,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：10/16 V认证状态：Not Qualified
座面最大高度：2.64 mm子类别：Power Management Circuits
最大供电电流 (Isup)：7 mA最大供电电压 (Vsup)：16 V
最小供电电压 (Vsup)：10 V标称供电电压 (Vsup)：12 V
表面贴装：YES温度等级：OTHER
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.49 mm
Base Number Matches：1

A8287SLB 数据手册

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A8285/A8287  
LNB Supply and Control Voltage Regulator  
ELECTRICAL CHARACTERISTICS (continued) at TA = +25°C, VIN = 10 to 16 V (unless otherwise noted)  
Characteristics  
Symbol  
Test Conditions  
Min. Typ. Max. Units  
Tone Characteristics  
Tone Frequency  
fTONE  
–
–
20  
22  
24  
kHz  
Tone Pull-Down Current  
ITONE  
tDEL  
30  
–
40  
–
50  
1
mA  
µs  
Tone Turn-On and Turn-Off Delays  
Using EXTM pin  
VIH  
VIL  
IIL  
–
–
–
2
–
–
–
–
–
0.8  
1
V
V
External Tone Logic Input  
Input Leakage  
–1  
µA  
Tone Detector Input Amplitude  
VTDI  
fTDI  
fIN = 22 kHz  
260  
17.6  
–
–
–
1000  
26.4  
–
mV  
kHz  
kΩ  
V
Tone Detector Frequency Capture  
Tone Detector Input Impedance  
Tone Detector Output Voltage  
600 mVpp sinewave  
See note 1  
ZTDI  
VOL  
IOL  
8.6  
–
Tone present, ILOAD = 3 mA  
Tone absent, VO = 7 V  
–
0.4  
10  
Tone Detector Output Leakage  
I2C Interface  
–
–
µA  
Logic Input (SDA,SCL) Low Level  
Logic Input (SDA,SCL) High Level  
Input Hysteresis  
VIL  
VIH  
–
–
–
–
2
–
–
–
0.8  
–
V
V
VHYS  
150  
–
mV  
Logic Input Current  
IIN  
VIN = 0 V to 7 V  
ILOAD = 3 mA  
–10 <±1.0  
10  
µA  
V
Output Voltage (SDA, IRQ)  
VOL  
–
–
–
–
–
–
–
–
–
–
–
–
–
–
0.4  
Output Leakage (SDA, IRQ)  
SCL Clock Frequency  
Output Fall Time  
IOL  
fCLK  
VO = 0 V to 7 V  
10  
400  
250  
–
µA  
kHz  
ns  
–
0
tOF  
VIH to VIL  
–
Bus Free Time Between Stop and Start  
Hold Time for Start Condition  
Setup Time for Start Condition  
SCL Low Time  
tBUF  
See I2C Interface Timing Diagram  
See I2C Interface Timing Diagram  
See I2C Interface Timing Diagram  
See I2C Interface Timing Diagram  
See I2C Interface Timing Diagram  
See note1; I2C Interface Timing Diagram  
See I2C Interface Timing Diagram  
See I2C Interface Timing Diagram  
1.3  
0.6  
0.6  
1.3  
0.6  
100  
0
µs  
µs  
µs  
µs  
µs  
ns  
tHD:STA  
tSU:STA  
tLOW  
–
–
–
SCL High Time  
tHIGH  
tSU:DAT  
tHD:DAT  
tSU:STO  
–
Data Setup Time  
–
Data Hold Time  
900  
–
ns  
Setup Time for Stop Condition  
0.6  
µs  
Continued on next page  
4
www.allegromicro.com  
115 Northeast Cutoff, Box 15036  
Worcester, Massachusetts 01615-0036 (508) 853-5000  
1234567...17

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与A8287SLB相关器件

型号 品牌 描述 获取价格 数据表
A8287SLBTR-T ALLEGRO Analog Circuit, 1 Func, PDSO24, BATWING, LEAD FREE, PLASTIC, SOIC-24

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