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A1425A-PLG84C

更新时间: 2024-02-18 05:22:07
品牌 Logo 应用领域
ACTEL 时钟可编程逻辑
页数 文件大小 规格书
68页 489K
描述
Field Programmable Gate Array, 310 CLBs, 2500 Gates, 125MHz, 310-Cell, CMOS, PQCC84, PLASTIC, LCC-84

A1425A-PLG84C 技术参数

是否Rohs认证: 符合生命周期:Transferred
包装说明:PLASTIC, LCC-84Reach Compliance Code:compliant
风险等级:5.77其他特性:MAX 70 I/OS
最大时钟频率:125 MHzCLB-Max的组合延迟:3 ns
JESD-30 代码:S-PQCC-J84JESD-609代码:e3
长度:29.3116 mm湿度敏感等级:3
可配置逻辑块数量:310等效关口数量:2500
输入次数:70逻辑单元数量:310
输出次数:70端子数量:84
最高工作温度:70 °C最低工作温度:
组织:310 CLBS, 2500 GATES封装主体材料:PLASTIC/EPOXY
封装代码:QCCJ封装等效代码:LDCC84,1.2SQ
封装形状:SQUARE封装形式:CHIP CARRIER
峰值回流温度(摄氏度):245电源:5 V
可编程逻辑类型:FIELD PROGRAMMABLE GATE ARRAY认证状态:Not Qualified
座面最大高度:4.57 mm子类别:Field Programmable Gate Arrays
最大供电电压:5.25 V最小供电电压:4.75 V
标称供电电压:5 V表面贴装:YES
技术:CMOS温度等级:COMMERCIAL
端子面层:MATTE TIN端子形式:J BEND
端子节距:1.27 mm端子位置:QUAD
处于峰值回流温度下的最长时间:40宽度:29.3116 mm
Base Number Matches:1

A1425A-PLG84C 数据手册

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P a c k a g e P i n A s s i g n m e n t s (c o n t in u e d )  
2 5 7 -P in C P G A (T o p Vie w )  
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A
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C
D
E
F
A
B
C
D
E
F
G
H
J
G
H
J
257-Pin  
CPGA  
K
L
K
L
M
N
P
R
T
M
N
P
R
T
V
X
Y
V
X
Y
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A14100 Function Location  
CLKA or I/O  
CLKB or I/O  
DCLK or I/O  
GND  
L4  
L5  
E4  
B16, C4, D4, D10, D16, E11, J5, K4, K16, L15, R4, T4, T10, T16, T17, X7  
HCLK or I/O  
IOCLK or I/O  
IOPCL or I/O  
MODE  
J16  
T5  
R16  
A5  
NC  
E5  
PRA OR I/O  
PRB or I/O  
SDI or I/O  
J1  
J17  
B4  
V
C3, C10, C13, C17, K3, K17, V3, V7, V10, V17, X14  
CC  
Notes:  
1. Unused I/O pins are designated as outputs by ALS and are driven low.  
2. All unassigned pins are available for use as I/Os.  
3. MODE should be terminated to GND through a 10K resistor to enable Actionprobe usage; otherwise it can be terminated directly to GND.  
1 -2 4 2  

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