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A1225XL-1PQG100C

更新时间： 2024-02-09 05:04:34

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ACTEL		时钟栅现场可编程门阵列可编程逻辑
页数	文件大小	规格书
84页	2085K
描述
Field Programmable Gate Array, 200MHz, 451-Cell, CMOS, PQFP100

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A1225XL-1PQG100C 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
Reach Compliance Code：	unknown	风险等级：	5.84
JESD-30 代码：	S-PQFP-G160	湿度敏感等级：	3
输入次数：	125	逻辑单元数量：	1362
输出次数：	125	端子数量：	160
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	QFP
封装等效代码：	QFP160,1.2SQ	封装形状：	SQUARE
封装形式：	FLATPACK	电源：	5 V
可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY	认证状态：	Not Qualified
子类别：	Field Programmable Gate Arrays	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子形式：	GULL WING
端子节距：	0.635 mm	端子位置：	QUAD
Base Number Matches：	1

A1225XL-1PQG100C 数据手册

Integrator Series FPGAs: 1200XL and 3200DX Families

Logic Modules

either a D-type flip-flop or a transparent latch. To increase

3200DX and 1200XL devices contain three types of logic

modules: combinatorial (C-modules), sequential

flexibility, the S-module register can be bypassed so that it

implements purely combinatorial logic.

(S-modules), and decode (D-modules). 1200XL devices

contain only the C-module and S-module, while the 3200DX

devices contain D-modules and dual-port SRAM modules in

addition to the S-module and C-module.

The C-module is shown in Figure 1 and implements the

following function:

D00

Y=!S1*!S0*D00+!S1*S0*D01+S1*!S0*D10+S1*S0*D11

D01

where:

D10

D11

S0=A0*B0

S1=A1+B1

The S-module shown in Figure 2 is designed to implement

high-speed sequential functions within a single logic

module. The S-module implements the same combinatorial

logic function as the C-module while adding a sequential

element. The sequential element can be configured as

Figure 1 • C-Module Implementation

D00

D01

D00

D01

OUT

D10

D11

GATE

CLR

Up to 7-Input Function Plus D-Type Flip-Flop with Clear

Up to 7-Input Function Plus Latch

D00

D01

OUT

D10

D11

GATE

CLR

Up to 8-Input Function (Same as C-Module)

Up to 4-Input Function Plus Latch with Clear

Figure 2 • S-Module Implementation

v3.0

1...3 4 567 8 9...84

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