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A1020B-1PQ100I

更新时间： 2024-01-08 02:43:43

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ACTEL		时钟栅可编程逻辑
页数	文件大小	规格书
24页	163K
描述
Field Programmable Gate Array, 547 CLBs, 2000 Gates, 47.7MHz, 547-Cell, CMOS, PQFP100, PLASTIC, MO-108, QFP-100

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A1020B-1PQ100I 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	PLASTIC, QFP-100
针数：	100	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.86
Is Samacsys：	N	其他特性：	MAX 69 I/OS
最大时钟频率：	47.7 MHz	CLB-Max的组合延迟：	3.8 ns
JESD-30 代码：	R-PQFP-G100	JESD-609代码：	e0
长度：	20 mm	湿度敏感等级：	3
可配置逻辑块数量：	547	等效关口数量：	2000
输入次数：	69	逻辑单元数量：	547
输出次数：	69	端子数量：	100
最高工作温度：	85 °C	最低工作温度：	-40 °C
组织：	547 CLBS, 2000 GATES	封装主体材料：	PLASTIC/EPOXY
封装代码：	QFP	封装等效代码：	QFP100,.7X.9
封装形状：	RECTANGULAR	封装形式：	FLATPACK
峰值回流温度（摄氏度）：	225	电源：	5 V
可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY	认证状态：	Not Qualified
座面最大高度：	3.4 mm	子类别：	Field Programmable Gate Arrays
最大供电电压：	5.5 V	最小供电电压：	4.5 V
标称供电电压：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	14 mm
Base Number Matches：	1

A1020B-1PQ100I 数据手册

The systems are available for 386/486/Pentium^™PC and for

HP^™and Sun^™workstations and for running Viewlogic^®,

Mentor Graphics^®, Cadence^™, OrCAD^™, and Synopsys

design environments.

Figure 1 • Partial View of an ACT 1 Device

A C T 1 D e v i c e S t r u c t u r e

A partial view of an ACT 1 device (Figure 1) depicts four logic

modules and distributed horizontal and vertical interconnect

tracks. PLICE antifuses, located at intersections of the

horizontal and vertical tracks, connect logic module inputs

and outputs. During programming, these antifuses are

addressed and programmed to make the connections

required by the circuit application.

T h e A C T 1 L o g i c M o d u l e

The ACT 1 logic module is an 8-input, one-output logic circuit

chosen for the wide range of functions it implements and for

its efficient use of interconnect routing resources (Figure 2).

The logic module can implement the four basic logic

functions (NAND, AND, OR, and NOR) in gates of two, three,

or four inputs. Each function may have many versions, with

different combinations of active-low inputs. The logic module

can also implement a variety of D-latches, exclusivity

functions, AND-ORs, and OR-ANDs. No dedicated hardwired

latches or flip-flops are required in the array, since latches

and flip-flops may be constructed from logic modules

wherever needed in the application.

Figure 2 • ACT 1 Logic Module

I /O B u f f e r s

Each I/O pin is available as an input, output, three-state, or

bidirectional buffer. Input and output levels are compatible

with standard TTL and CMOS specifications. Outputs sink or

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型号	品牌	描述	获取价格	数据表
A1020B-1PQ100M	ACTEL	Field Programmable Gate Array, 547 CLBs, 2000 Gates, CMOS, PQFP100, PLASTIC, QFP-100	获取价格
A1020B-1PQ84B	ACTEL	ACT 1 Series FPGAs	获取价格
A1020B-1PQ84C	ACTEL	ACT 1 Series FPGAs	获取价格
A1020B-1PQ84I	ACTEL	ACT 1 Series FPGAs	获取价格
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A1020B-1PQG100C	ACTEL	Field Programmable Gate Array, 547 CLBs, 2000 Gates, 53MHz, 547-Cell, CMOS, PQFP100, PLAST	获取价格

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