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A1020B-1PL84B

更新时间： 2024-01-14 10:19:54

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ACT 1 Series FPGAs

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A1020B-1PL84B 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
包装说明：	QCCJ,	Reach Compliance Code：	compliant
ECCN代码：	3A001.A.2.C	HTS代码：	8542.39.00.01
风险等级：	5.8	Is Samacsys：	N
JESD-30 代码：	S-PQCC-J84	JESD-609代码：	e0
长度：	29.3116 mm	湿度敏感等级：	3
可配置逻辑块数量：	547	等效关口数量：	2000
端子数量：	84	最高工作温度：	125 °C
最低工作温度：	-55 °C	组织：	547 CLBS, 2000 GATES
封装主体材料：	PLASTIC/EPOXY	封装代码：	QCCJ
封装形状：	SQUARE	封装形式：	CHIP CARRIER
峰值回流温度（摄氏度）：	225	可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY
认证状态：	Not Qualified	座面最大高度：	4.572 mm
最大供电电压：	5.5 V	最小供电电压：	4.5 V
标称供电电压：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	MILITARY
端子面层：	TIN LEAD	端子形式：	J BEND
端子节距：	1.27 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	29.3116 mm
Base Number Matches：	1

A1020B-1PL84B 数据手册

The systems are available for 386/486/Pentium^™PC and for

HP^™and Sun^™workstations and for running Viewlogic^®,

Mentor Graphics^®, Cadence^™, OrCAD^™, and Synopsys

design environments.

Figure 1 • Partial View of an ACT 1 Device

A C T 1 D e v i c e S t r u c t u r e

A partial view of an ACT 1 device (Figure 1) depicts four logic

modules and distributed horizontal and vertical interconnect

tracks. PLICE antifuses, located at intersections of the

horizontal and vertical tracks, connect logic module inputs

and outputs. During programming, these antifuses are

addressed and programmed to make the connections

required by the circuit application.

T h e A C T 1 L o g i c M o d u l e

The ACT 1 logic module is an 8-input, one-output logic circuit

chosen for the wide range of functions it implements and for

its efficient use of interconnect routing resources (Figure 2).

The logic module can implement the four basic logic

functions (NAND, AND, OR, and NOR) in gates of two, three,

or four inputs. Each function may have many versions, with

different combinations of active-low inputs. The logic module

can also implement a variety of D-latches, exclusivity

functions, AND-ORs, and OR-ANDs. No dedicated hardwired

latches or flip-flops are required in the array, since latches

and flip-flops may be constructed from logic modules

wherever needed in the application.

Figure 2 • ACT 1 Logic Module

I /O B u f f e r s

Each I/O pin is available as an input, output, three-state, or

bidirectional buffer. Input and output levels are compatible

with standard TTL and CMOS specifications. Outputs sink or

1 -2 8 4

123 4 5 6 7...24

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型号	品牌	描述	获取价格	数据表
A1020B-1PL84C	ACTEL	ACT 1 Series FPGAs	获取价格
A1020B-1PL84C	MICROSEMI	Field Programmable Gate Array, 547 CLBs, 2000 Gates, 53MHz, 547-Cell, CMOS, PQCC84, PLASTI	获取价格
A1020B-1PL84I	ACTEL	ACT 1 Series FPGAs	获取价格
A1020B-1PL84I	MICROSEMI	Field Programmable Gate Array, 547 CLBs, 2000 Gates, 47.7MHz, 547-Cell, CMOS, PQCC84, PLAS	获取价格
A1020B-1PL84M	ACTEL	ACT 1 Series FPGAs	获取价格
A1020B-1PL84M	MICROSEMI	Field Programmable Gate Array, 547 CLBs, 2000 Gates, CMOS, PQCC84, PLASTIC, LCC-84	获取价格

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