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A1020B-1PL44C

更新时间： 2024-02-01 19:15:18

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美高森美 - MICROSEMI		栅
页数	文件大小	规格书
24页	159K
描述
Field Programmable Gate Array, 547 CLBs, 2000 Gates, 53MHz, 547-Cell, CMOS, PQCC44, PLASTIC, LCC-44

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A1020B-1PL44C 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	LCC	包装说明：	QCCJ, LDCC44,.7SQ
针数：	44	Reach Compliance Code：	compliant
风险等级：	5.86	Is Samacsys：	N
其他特性：	MAX 34 I/OS	最大时钟频率：	53 MHz
CLB-Max的组合延迟：	3.8 ns	JESD-30 代码：	S-PQCC-J44
JESD-609代码：	e0	长度：	16.5862 mm
湿度敏感等级：	3	可配置逻辑块数量：	547
等效关口数量：	2000	输入次数：	69
逻辑单元数量：	547	输出次数：	69
端子数量：	44	最高工作温度：	70 °C
最低工作温度：		组织：	547 CLBS, 2000 GATES
封装主体材料：	PLASTIC/EPOXY	封装代码：	QCCJ
封装等效代码：	LDCC44,.7SQ	封装形状：	SQUARE
封装形式：	CHIP CARRIER	峰值回流温度（摄氏度）：	225
电源：	5 V	可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY
认证状态：	Not Qualified	座面最大高度：	4.572 mm
子类别：	Field Programmable Gate Arrays	最大供电电压：	5.25 V
最小供电电压：	4.75 V	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	TIN LEAD
端子形式：	J BEND	端子节距：	1.27 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	16.5862 mm	Base Number Matches：	1

A1020B-1PL44C 数据手册

The systems are available for 386/486/Pentium^™PC and for

HP^™and Sun^™workstations and for running Viewlogic^®,

Mentor Graphics^®, Cadence^™, OrCAD^™, and Synopsys

design environments.

Figure 1 • Partial View of an ACT 1 Device

A C T 1 D e v i c e S t r u c t u r e

A partial view of an ACT 1 device (Figure 1) depicts four logic

modules and distributed horizontal and vertical interconnect

tracks. PLICE antifuses, located at intersections of the

horizontal and vertical tracks, connect logic module inputs

and outputs. During programming, these antifuses are

addressed and programmed to make the connections

required by the circuit application.

T h e A C T 1 L o g i c M o d u l e

The ACT 1 logic module is an 8-input, one-output logic circuit

chosen for the wide range of functions it implements and for

its efficient use of interconnect routing resources (Figure 2).

The logic module can implement the four basic logic

functions (NAND, AND, OR, and NOR) in gates of two, three,

or four inputs. Each function may have many versions, with

different combinations of active-low inputs. The logic module

can also implement a variety of D-latches, exclusivity

functions, AND-ORs, and OR-ANDs. No dedicated hardwired

latches or flip-flops are required in the array, since latches

and flip-flops may be constructed from logic modules

wherever needed in the application.

Figure 2 • ACT 1 Logic Module

I /O B u f f e r s

Each I/O pin is available as an input, output, three-state, or

bidirectional buffer. Input and output levels are compatible

with standard TTL and CMOS specifications. Outputs sink or

1 -2 8 4

123 4 5 6 7...24

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型号	品牌	描述	获取价格	数据表
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A1020B-1PL44M	ACTEL	Field Programmable Gate Array, 547 CLBs, 2000 Gates, 547-Cell, CMOS, PQCC44, PLASTIC, LCC-	获取价格
A1020B-1PL68C	MICROSEMI	暂无描述	获取价格
A1020B-1PL68C	ACTEL	Field Programmable Gate Array, 547 CLBs, 2000 Gates, 53MHz, 547-Cell, CMOS, PQCC68, PLASTI	获取价格
A1020B-1PL68I	MICROSEMI	Field Programmable Gate Array, 547 CLBs, 2000 Gates, 47.7MHz, 547-Cell, CMOS, PQCC68, PLAS	获取价格

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