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845254

更新时间： 2024-01-08 13:50:36
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艾迪悌 - IDT /
页数 文件大小 规格书
20页 246K
描述
FemtoClock Crystal-to-3.3V, 2.5V

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845254 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：VFQFPN
包装说明：VFQFN-32针数：32
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.8
其他特性：CAN ALSO OPERATES AT 2.5V SUPPLYJESD-30 代码：S-XQCC-N32
JESD-609代码：e3长度：5 mm
湿度敏感等级：3端子数量：32
最高工作温度：85 °C最低工作温度：-40 °C
最大输出时钟频率：312.5 MHz封装主体材料：UNSPECIFIED
封装代码：HVQCCN封装等效代码：LCC32,.2SQ,20
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260电源：2.5/3.3 V
主时钟/晶体标称频率：25 MHz认证状态：Not Qualified
座面最大高度：1 mm子类别：Clock Generators
最大压摆率：88 mA最大供电电压：3.465 V
最小供电电压：3.135 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn) - annealed
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：5 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, OTHER
Base Number Matches：1

845254 数据手册

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845254 Data Sheet  
FEMTOCLOCK® CRYSTAL-TO-CML CLOCK GENERATOR  
Table 1. Pin Descriptions  
Number  
1, 2  
Name  
nQ0, Q0  
VDD  
Type  
Description  
Output  
Power  
Input  
Differential clock output pair. CML interface levels.  
Core supply pins.  
3, 18  
4
nOE  
Pulldown  
Output enable pin. See Table 3E for function. LVCMOS/LVTTL interface levels.  
5, 6, 7, 8, 9, 16,  
17, 19, 25, 32  
nc  
Unused  
Do not connect.  
10  
11  
VDDA  
nBYPASS  
REF_CLK  
GND  
Power  
Input  
Analog supply pin.  
Pullup  
PLL bypass pin. See Table 3D for function. LVCMOS/LVTTL interface levels.  
Single-ended reference clock input. LVCMOS/LVTTL interface levels.  
Power supply ground.  
12  
Input  
Pulldown  
13, 29  
Power  
14,  
15  
XTAL_OUT,  
XTAL_IN  
Input  
Input  
Crystal oscillator interface. XTAL_IN is the input, XTAL_OUT is the output.  
FSEL0,  
FSEL1  
Output frequency divider select enable pins. See Table 3C for function.  
LVCMOS/LVTTL interface levels.  
20, 21  
Pulldown  
Pulldown  
PLL reference clock select pin. See Table 3A for function.  
LVCMOS/LVTTL interface levels.  
22  
23, 24  
26  
REF_SEL  
Q3, nQ3  
FBSEL  
Input  
Output  
Input  
Differential clock output pair. CML interface levels.  
PLL feedback divider select pin. See Table 3B for function.  
LVCMOS/LVTTL interface levels.  
Pulldown  
27, 28  
30, 31  
nQ2, Q2  
nQ1, Q1  
Output  
Output  
Differential clock output pair. CML interface levels.  
Differential clock output pair. CML interface levels.  
NOTE: Pulldown and pullup refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.  
Table 2. Pin Characteristics  
Symbol  
Parameter  
Test Conditions  
Minimum  
Typical  
Maximum  
Units  
pF  
CIN  
Input Capacitance  
4
RPULLDOWN Input Pulldown Resistor  
RPULLUP Input Pullup Resistor  
51  
51  
k  
k  
845254 REVISION B 08/25/15  
2
©2015 Integrated Device Technology, Inc.  
1234567...20

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