810001DK-21T

更新时间： 2024-02-01 17:33:58

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艾迪悌 - IDT		石英晶振压控振荡器时钟
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19页	798K
描述
FemtoClock Dual VCXO Video PLL One LVCMOS/LVTTL clock output

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810001DK-21T 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFN	包装说明：	5 X 5 MM, 0.95 MM HEIGHT, MO-220VHHD-2, VFQFN-32
针数：	32	Reach Compliance Code：	not_compliant
HTS代码：	8542.39.00.01	风险等级：	5.4
系列：	810001	输入调节：	MUX
JESD-30 代码：	S-XQCC-N32	JESD-609代码：	e0
长度：	5 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
湿度敏感等级：	3	功能数量：	1
反相输出次数：		端子数量：	32
实输出次数：	2	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	225
认证状态：	Not Qualified	座面最大高度：	1 mm
最大供电电压 (Vsup)：	3.465 V	最小供电电压 (Vsup)：	3.135 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn85Pb15)
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	5 mm	最小 fmax：	175 MHz
Base Number Matches：	1

810001DK-21T 数据手册

FemtoClock™ Dual VCXO Video PLL

ICS810001-21

DATA SHEET

General Description

Features

The ICS810001-21 is a PLL based synchronous clock

generator that is optimized for digital video clock jitter

attenuation and frequency translation. The device

contains two internal frequency multiplication stages

that are cascaded in series. The first stage is a VCXO

• Jitter attenuation and frequency translation of video clock signals

• Supports SMPTE 292M, ITU-R Rec. 601/656 and

HiPerClockS™

MPEG-transport clocks

• Support of High-Definition (HD) and Standard-Definition (SD)

pixel rates

PLL that is optimized to provide reference clock jitter attenuation,

and to support the complex PLL multiplication ratios needed for

video rate conversion. The second stage is a FemtoClock™

frequency multiplier that provides the low jitter, high frequency video

output clock.

• Dual VCXO-PLL supports both 60 and 59.94Hz base frame rates

in one device

• Supports both 1000/1001 and 1001/1000 rate conversions

• Dual PLL mode for high-frequency clock generation (36MHz to

148.5MHz)

Preset multiplication ratios are selected from internal lookup tables

using device input selection pins. The multiplication ratios are

optimized to support most common video rates used in professional

video system applications. The VCXO requires the use of an

external, inexpensive pullable crystal. Two crystal connections are

provided (pin selectable) so that both 60 and 59.94 base frame rates

can be supported. The VCXO requires external passive loop filter

components which are used to set the PLL loop bandwidth and

damping characteristics.

• VCXO-PLL mode for low-frequency clock generation (27MHz and

26.973MHz)

• One LVCMOS/LVTTL clock output

• Two selectable LVCMOS/LVTTL clock inputs

• LVCMOS/LVTTL compatible control signals

• RMS phase jitter @148.3516MHz, (12kHz - 20MHz):

1.089ps (typical)

• 3.3V supply voltage

• 0°C to 70°C ambient operating temperature

• Available in both standard (RoHS 5) and lead-free (RoHS 6)

packages

Supported Input Frequencies

Supported Output Frequencies

f_VCXO= 27MHz

27.0000MHz

27.0270MHz

74.1758MHz

74.3243MHz

74.2500MHz

27.0270MHz

26.9730MHz

74.1758MHz

45.0000kHz

33.7500kHz

15.6250kHz

15.7343kHz

28.1250kHz

f_VCXO= 26.973MHz

26.9730MHz

27.0000MHz

74.1016MHz

74.2499MHz

74.1758MHz

27.0000MHz

26.9461MHz

74.1016kHz

44.9550kHz

33.7163kHz

15.6094kHz

15.7185kHz

28.0969kHz

f_VCXO= 27MHz

148.5000MHz

74.2500MHz

49.5000MHz

33.0000MHz

162.0000MHz

81.0000MHz

54.0000MHz

36.0000MHz

27.0000MHz

f_VCXO= 26.973MHz

148.3515MHz

74.1758MHz

49.4505MHz

32.9670MHz

161.8380MHz

80.9190MHz

53.9460MHz

35.9640MHz

26.9730MHz

ICS810001DK-21 REVISION B APRIL 13, 2010

12 3 4 5 6 7...19

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