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Datasheet > 电信电路 > 其他电信集成电路> 78P2344-IEL/A07R/F
78P2344-IEL/A07R/F PDF预览

78P2344-IEL/A07R/F

更新时间： 2024-01-05 15:55:47
品牌 Logo 应用领域
TERIDIAN /
页数 文件大小 规格书
37页 353K
描述
Telecom IC, PQFP100,

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78P2344-IEL/A07R/F 技术参数

是否Rohs认证： 符合生命周期：Active
包装说明：QFP, QFP100,.63SQ,20Reach Compliance Code：compliant
风险等级：5.41运营商类型：E-3
运营商类型（2）：STS-1/OC-1运营商类型（3）：T-3(DS3)
JESD-30 代码：S-PQFP-G100端子数量：100
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：QFP
封装等效代码：QFP100,.63SQ,20封装形状：SQUARE
封装形式：FLATPACK电源：3.3 V
认证状态：Not Qualified子类别：Other Telecom ICs
最大压摆率：355 mA标称供电电压：3.3 V
表面贴装：YES温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD

78P2344-IEL/A07R/F 数据手册

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78P2344JAT  
4-port E3/DS3/STS-1 LIU  
with Jitter Attenuator  
REGISTER DESCRIPTION  
REGISTER ADDRESSING  
Address Bits  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
Bit 3  
Bit 2  
Sub-Address  
SA[1]  
Bit 1  
Bit 0  
Read/  
Write  
Port Address  
Assignment  
PA[3]  
PA[2]  
PA[1]  
PA[0]  
SA[2]  
SA[0]  
R/W*  
REGISTER TABLE  
a) PA[3:0] = 0 : Global Registers  
Reg.  
Name  
Sub  
Addr  
Description  
Master Control  
Interrupt Control  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
Bit 3  
Bit 2  
Bit 1  
Bit 0  
REGEN  
<0>  
INPOL  
<0>  
E3  
<X>  
ENDECB RCLKP  
TCLKP  
<0>  
JAER  
<0>  
SRST  
<0>  
TXER  
<1>  
MSCR  
(R/W)  
DS3  
<X>  
0
1
--  
<0>  
--  
<0>  
--  
INTC  
(R/W)  
RXER  
<1>  
--  
--  
2
3
4
5
6
7
RSVD  
RSVD  
RSVD  
RSVD  
RSVD  
RSVD  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
--  
--  
--  
--  
--  
--  
--  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
b) PA[3:0] = 1-4 : Port-Specific Registers  
Reg.  
Name  
Sub  
Addr  
Description  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
Bit 3  
Bit 2  
Bit 1  
Bit 0  
MDCR  
(R/W)  
PDTX  
<0>  
PDRX  
<0>  
LBO  
<1>  
LLBKA  
<0>  
LLBKB  
<0>  
RLBK  
<0>  
MON  
<0>  
TXEN  
<1>  
0
Mode Control  
STAT  
(R/O)  
--  
--  
--  
1
2
3
Status Monitor  
Reserved  
FERR  
LOS  
TXNW  
--  
SGLO  
RSVD  
<1>  
<1>  
<0>  
<1>  
<0>  
<0>  
<1>  
<0>  
<0>  
<0>  
JACR  
(R/W)  
Jitter Attenuator  
Control  
JAEN  
<X>  
JASL  
<X>  
JLBK  
<0>  
ESP[1]  
<1>  
ESP[0]  
<1>  
JABW  
<X>  
4
5
6
7
RSVD  
RSVD  
RSVD  
RSVD  
Reserved  
Reserved  
Reserved  
Reserved  
--  
--  
--  
--  
--  
--  
--  
--  
--  
--  
<0>  
--  
<0>  
--  
<0>  
--  
<0>  
--  
<0>  
--  
<0>  
--  
--  
--  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
Note: Shaded registers in Register Table are reserved for Teridian internal use only. Accessing reserved or  
undefined registers may cause undesirable operation.  
Page 7 of 37  
2005 Teridian Semiconductor Corporation  
Rev 2.2  
1...45678910...37

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型号 品牌 描述 获取价格 数据表
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