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74LV4094DB,118

更新时间: 2024-01-03 18:38:56
品牌 Logo 应用领域
恩智浦 - NXP PC光电二极管逻辑集成电路触发器
页数 文件大小 规格书
21页 109K
描述
74LV4094 - 8-stage shift-and-store bus register SSOP1 16-Pin

74LV4094DB,118 技术参数

是否Rohs认证:符合生命周期:Transferred
零件包装代码:SSOP1包装说明:SSOP, SSOP16,.3
针数:16Reach Compliance Code:compliant
HTS代码:8542.39.00.01风险等级:5.25
Is Samacsys:N其他特性:SISO OPERATION ALSO AVAILABLE
计数方向:RIGHT系列:LV/LV-A/LVX/H
JESD-30 代码:R-PDSO-G16JESD-609代码:e4
长度:6.2 mm负载电容(CL):50 pF
逻辑集成电路类型:SERIAL IN PARALLEL OUT湿度敏感等级:1
位数:8功能数量:1
端子数量:16最高工作温度:125 °C
最低工作温度:-40 °C输出特性:3-STATE
输出极性:TRUE封装主体材料:PLASTIC/EPOXY
封装代码:SSOP封装等效代码:SSOP16,.3
封装形状:RECTANGULAR封装形式:SMALL OUTLINE, SHRINK PITCH
峰值回流温度(摄氏度):260电源:3.3 V
传播延迟(tpd):90 ns认证状态:Not Qualified
座面最大高度:2 mm子类别:Shift Registers
最大供电电压 (Vsup):3.6 V最小供电电压 (Vsup):1 V
标称供电电压 (Vsup):3.3 V表面贴装:YES
技术:CMOS温度等级:AUTOMOTIVE
端子面层:Nickel/Palladium/Gold (Ni/Pd/Au)端子形式:GULL WING
端子节距:0.65 mm端子位置:DUAL
处于峰值回流温度下的最长时间:30触发器类型:POSITIVE EDGE
宽度:5.3 mm最小 fmax:20 MHz
Base Number Matches:1

74LV4094DB,118 数据手册

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74LV4094  
Philips Semiconductors  
8-stage shift-and-store bus register  
6.2 Pin description  
Table 2.  
Symbol  
STR  
D
Pin description  
Pin  
1
Description  
data strobe input  
data serial input  
2
CP  
3
clock input (edge triggered LOW-to-HIGH)  
data parallel output 0  
data parallel output 1  
data parallel output 2  
data parallel output 3  
ground (0 V)  
QP0  
QP1  
QP2  
QP3  
GND  
QS1  
QS2  
QP7  
QP6  
QP5  
QP4  
OE  
4
5
6
7
8
9
data serial output 1  
data serial output 2  
data parallel output 7  
data parallel output 6  
data parallel output 5  
data parallel output 4  
output enable input  
supply voltage  
10  
11  
12  
13  
14  
15  
16  
VCC  
7. Functional description  
Table 3.  
Function table  
H = HIGH voltage level; L = LOW voltage level; X = don’t care; Z = high-impedance OFF-state; n.c. = no change;  
= LOW-to-HIGH clock transition; = HIGH-to-LOW clock transition.  
Input  
Parallel output  
Serial output  
QS1[1]  
QS6  
CP  
OE  
L
STR  
X
D
X
X
X
L
QP0  
Z
QPn  
Z
QS2  
n.c.  
L
X
Z
Z
n.c.  
QP7  
n.c.  
H
H
H
H
L
n.c.  
L
n.c.  
QS6  
H
QPn1  
QPn1  
n.c.  
QS6  
n.c.  
H
H
H
H
QS6  
n.c.  
H
n.c.  
n.c.  
QP7  
[1] QS6 = the information in the 7th register stage is transferred to the 8th register stage and QS1, QS2 clock edge.  
74LV4094_2  
© Koninklijke Philips Electronics N.V. 2006. All rights reserved.  
Product data sheet  
Rev. 02 — 29 June 2006  
4 of 21  
 
 
 

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