74F573LMQB

更新时间： 2024-02-06 15:24:05

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美国国家半导体 - NSC		锁存器
页数	文件大小	规格书
8页	168K
描述
Octal D-Type Latch with TRI-STATE Outputs

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技术参数
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74F573LMQB 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
包装说明：	SOP, SOP20,.3	Reach Compliance Code：	compliant
风险等级：	5.84	JESD-30 代码：	R-PDSO-G20
逻辑集成电路类型：	D LATCH	最大I（ol）：	0.024 A
位数：	8	功能数量：	1
端子数量：	20	最高工作温度：	70 °C
最低工作温度：		输出特性：	3-STATE
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP20,.3	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	包装方法：	TAPE AND REEL
电源：	5 V	最大电源电流（ICC）：	55 mA
Prop。Delay @ Nom-Sup：	8 ns	认证状态：	Not Qualified
子类别：	FF/Latches	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	TTL
温度等级：	COMMERCIAL	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
Base Number Matches：	1

74F573LMQB 数据手册

Unit Loading/Fan Out

54F/74F

Pin Names

Description

U.L.

Input I /I

IH IL

Output I /I

HIGH/LOW

OH OL

20 mA/ 0.6 mA

D –D

Data Inputs

1.0/1.0

Latch Enable Input (Active HIGH)

TRI-STATE Output Enable Input

(Active LOW)

1.0/1.0

20 mA/ 0.6 mA

O –O

TRI-STATE Latch Outputs

150/40(33.3)

3 mA/24 mA (20 mA)

Functional Description

The ’F573 contains eight D-type latches with 3-state output

Function Table

buffers. When the Latch Enable (LE) input is HIGH, data on

the D inputs enters the latches. In this condition the latch-

Inputs

Outputs

es are transparent, i.e., a latch output will change state each

time its D input changes. When LE is LOW the latches store

the information that was present on the D inputs a setup

time preceding the HIGH-to-LOW transition of LE. The 3-

state buffers are controlled by the Output Enable (OE) input.

When OE is LOW, the buffers are in the bi-state mode.

When OE is HIGH the buffers are in the high impedance

mode but this does not interfer with entering new data into

the latches.

HIGH Voltage Level

LOW Voltage Level

Immaterial

Value stored from previous clock cycle

Logic Diagram

TL/F/9566–5

Please note that this diagram is provided only for the understanding of logic operations and should not be used to estimate propagation delays.

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