74F174

更新时间： 2024-01-07 23:40:28

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飞兆/仙童 - FAIRCHILD		触发器
页数	文件大小	规格书
6页	60K
描述
Hex D-Type Flip-Flop with Master Reset

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技术参数
数据手册

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74F174 技术参数

生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	SOP,	针数：	16
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.65	系列：	F/FAST
JESD-30 代码：	R-PDSO-G16	长度：	10.3 mm
逻辑集成电路类型：	D FLIP-FLOP	位数：	6
功能数量：	1	端子数量：	16
最高工作温度：	70 °C	最低工作温度：
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	传播延迟（tpd）：	11 ns
认证状态：	Not Qualified	座面最大高度：	2.65 mm
最大供电电压 (Vsup)：	5.25 V	最小供电电压 (Vsup)：	4.75 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	TTL	温度等级：	COMMERCIAL
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	触发器类型：	POSITIVE EDGE
宽度：	7.5 mm	最小 fmax：	140 MHz
Base Number Matches：	1

74F174 数据手册

Unit Loading/Fan Out

Input I_IH/I_IL

U.L.

Pin Names

Description

Output I_OH/I_OL

HIGH/LOW

1.0/1.0

D₀–D₅

Data Inputs

20 µA/−0.6 mA

Clock Pulse Input (Active Rising Edge)

1.0/1.0

Master Reset Input (Active LOW)

Outputs

1.0/1.0

50/33.3

20 µA/−0.6 mA

−1 mA/20 mA

Q₀–Q₅

Functional Description

Truth Table

The 74F174 consists of six edge-triggered D-type flip-flops

with individual D inputs and Q outputs. The Clock (CP) and

Master Reset (MR) are common to all flip-flops. Each D

input’s state is transferred to the corresponding flip-flop’s

output following the LOW-to-HIGH Clock (CP) transition. A

LOW input to the Master Reset (MR) will force all outputs

LOW independent of Clock or Data inputs. The 74F174 is

useful for applications where the true output only is

required and the Clock and Master Reset are common to

all storage elements.

Inputs

Outputs

Q_n

D_n

H = HIGH Voltage Level

L = LOW Voltage Level

X = Immaterial

= LOW-to-HIGH Clock Transition

Logic Diagram

Please note that this diagram is provided only for the understanding of logic operations and should not be used to estimate propagation delays.

www.fairchildsemi.com

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