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5V50012LCG

更新时间： 2024-02-11 23:17:06

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艾迪悌 - IDT		驱动逻辑集成电路
页数	文件大小	规格书
11页	197K
描述
PLL Based Clock Driver, 5V Series, 1 True Output(s), 0 Inverted Output(s), CMOS, LCC-16

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5V50012LCG 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	LCC
包装说明：	QCCN,	针数：	16
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.72	系列：	5V
输入调节：	STANDARD	JESD-30 代码：	R-XQCC-N16
JESD-609代码：	e3	长度：	8.509 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	功能数量：	1
反相输出次数：		端子数量：	16
实输出次数：	1	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	UNSPECIFIED
封装代码：	QCCN	封装形状：	RECTANGULAR
封装形式：	CHIP CARRIER	峰值回流温度（摄氏度）：	260
座面最大高度：	1.6764 mm	最大供电电压 (Vsup)：	3.45 V
最小供电电压 (Vsup)：	3.15 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	MATTE TIN
端子形式：	NO LEAD	端子节距：	1.27 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	6.858 mm	Base Number Matches：	1

5V50012LCG 数据手册

IDT5V50012

CRYSTAL-FREE CLOCK SOURCE

SYNTHESIZERS

Timing Diagrams

t₁

t₂

VDDs

Outputs

VDD

0.1µF

C_LOAD

DUT

50% of VDD

GND

Clock

Output

Figure 2: Duty Cycle Definitions

Figure 1: Test and Measurement Setup

Power Up

Time

VCO Ramp

Time

PLL Locked

VDD

t₄

t₃

VDD

80% of VDD

VDD

20% of VDD

Clock

Output

0 ms

4 ms

10 ms

Figure 4: Power Up and PLL Lock Timing

Figure 3: Rise and Fall Time Definitions

PDTS

1.5 V

t_DIS

Mean value

t_EN

VOH

CLK

Outputs

Short-term jitter

0 V

Figure 6: Short Term Jitter Definition

Figure 5: PDTS to Stable Clock Output Timing

IDT™ CRYSTAL-FREE CLOCK SOURCE

IDT5V50012

REV B 061807

1...4 5 678 9 10 11

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型号	品牌	描述	获取价格	数据表
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