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5M240ZT100I5

更新时间： 2024-01-25 05:34:09

品牌	Logo	应用领域
阿尔特拉 - ALTERA		时钟可编程逻辑
页数	文件大小	规格书
166页	3966K
描述
Flash PLD, 14ns, PQFP100, 16 X 16 MM, 0.50 MM PITCH, TQFP-100

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5M240ZT100I5 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	TFQFP, TQFP100,.63SQ	Reach Compliance Code：	compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	0.98	Samacsys Confidence：	3
Samacsys Status：	Released	2D Presentation：	https://componentsearchengine.com/2D/0T/1376791.1.2.png
Schematic Symbol：	https://componentsearchengine.com/symbol.php?partID=1376791	PCB Footprint：	https://componentsearchengine.com/footprint.php?partID=1376791
3D View：	https://componentsearchengine.com/viewer/3D.php?partID=1376791	Samacsys PartID：	1376791
Samacsys Image：	https://componentsearchengine.com/Images/9/5M240ZT100I5N.jpg	Samacsys Thumbnail Image：	https://componentsearchengine.com/Thumbnails/1/5M240ZT100I5N.jpg
Samacsys Pin Count：	100	Samacsys Part Category：	Integrated Circuit
Samacsys Package Category：	Quad Flat Packages	Samacsys Footprint Name：	100-Pin TQFP
Samacsys Released Date：	2018-10-22 08:47:48	Is Samacsys：	N
其他特性：	YES	最大时钟频率：	118.3 MHz
系统内可编程：	YES	JESD-30 代码：	S-PQFP-G100
JESD-609代码：	e3	JTAG BST：	YES
长度：	14 mm	I/O 线路数量：	79
宏单元数：	192	端子数量：	100
最高工作温度：	100 °C	最低工作温度：	-40 °C
组织：	79 I/O	输出函数：	MACROCELL
封装主体材料：	PLASTIC/EPOXY	封装代码：	TFQFP
封装等效代码：	TQFP100,.63SQ	封装形状：	SQUARE
封装形式：	FLATPACK, THIN PROFILE, FINE PITCH	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	1.8,1.2/3.3 V	可编程逻辑类型：	FLASH PLD
传播延迟：	14 ns	认证状态：	Not Qualified
座面最大高度：	1.2 mm	子类别：	Programmable Logic Devices
最大供电电压：	1.89 V	最小供电电压：	1.71 V
标称供电电压：	1.8 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	MATTE TIN	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	14 mm
Base Number Matches：	1

5M240ZT100I5 数据手册

Contents

Chapter 8. JTAG Boundary-Scan Testing in MAX V Devices

IEEE Std. 1149.1 BST Architecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–2

IEEE Std. 1149.1 Boundary-Scan Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–3

Boundary-Scan Cells of a MAX V Device I/O Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–4

JTAG Pins and Power Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–5

IEEE Std. 1149.1 BST Operation Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–6

SAMPLE/PRELOAD Instruction Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–8

EXTEST Instruction Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–10

BYPASS Instruction Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–12

IDCODE Instruction Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–12

USERCODE Instruction Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–13

CLAMP Instruction Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–13

HIGHZ Instruction Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–13

I/O Voltage Support in the JTAG Chain . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–13

Boundary-Scan Test for Programmed Devices . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–14

Disabling IEEE Std. 1149.1 BST Circuitry . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–15

Guidelines for IEEE Std. 1149.1 Boundary-Scan Testing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–15

Boundary-Scan Description Language Support . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–15

Document Revision History . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8–16

Additional Information

Document Revision History . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . Info–1

How to Contact Altera . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . Info–1

Typographic Conventions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . Info–1

MAX V Device Handbook

May 2011 Altera Corporation

1...3 4 567 8 9...166

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与5M240ZT100I5相关器件

型号	品牌	描述	获取价格	数据表
5M240ZT144A5N	INTEL	Flash PLD, 17.7ns, 192-Cell, CMOS, PQFP144	获取价格
5M240ZT144C4	ALTERA	Flash PLD, 9.5ns, PQFP144, 22 X 22 MM, 0.50 MM PITCH, TQFP-144	获取价格
5M240ZT144C4N	ALTERA	Flash PLD, 9.5ns, 192-Cell, CMOS, PQFP144, 22 X 22 MM, 0.50 MM PITCH, LEAD FREE, TQFP-144	获取价格
5M240ZT144I5N	ALTERA	Flash PLD, 17.7ns, 192-Cell, CMOS, PQFP144, 22 X 22 MM, 0.50 MM PITCH, LEAD FREE, TQFP-144	获取价格
5M240ZT64A4N	ALTERA	MAX V Device Handbook	获取价格
5M240ZT64A5N	ALTERA	MAX V Device Handbook	获取价格

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8

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