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5AGXFB5K4F40I5N

更新时间： 2024-01-09 18:19:56

品牌	Logo	应用领域
英特尔 - INTEL		栅可编程逻辑
页数	文件大小	规格书
182页	2239K
描述
Field Programmable Gate Array, 622MHz, PBGA1517, ROHS COMPLIANT, FBGA-1517

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5AGXFB5K4F40I5N 技术参数

是否Rohs认证：	符合	生命周期：	End Of Life
包装说明：	FBGA-1517	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.29
JESD-30 代码：	S-PBGA-B1517	JESD-609代码：	e1
长度：	40 mm	湿度敏感等级：	3
可配置逻辑块数量：	15850	输入次数：	704
逻辑单元数量：	420000	输出次数：	704
端子数量：	1517	最高工作温度：	100 °C
最低工作温度：	-40 °C	组织：	15850 CLBS
封装主体材料：	PLASTIC/EPOXY	封装代码：	BGA
封装等效代码：	BGA1517,39X39,40	封装形状：	SQUARE
封装形式：	GRID ARRAY	峰值回流温度（摄氏度）：	NOT SPECIFIED
可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY	座面最大高度：	2.7 mm
最大供电电压：	1.13 V	最小供电电压：	1.07 V
标称供电电压：	1.1 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子面层：	Tin/Silver/Copper (Sn/Ag/Cu)
端子形式：	BALL	端子节距：	1 mm
端子位置：	BOTTOM	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	40 mm	Base Number Matches：	1

5AGXFB5K4F40I5N 数据手册

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AV-51002

2015.12.16

2-76

Glossary

Term

Definition

JTAG Timing Specifi‐ JTAG Timing Specifications:

cations

TMS

TDI

JCP

JPH

JCH

JCL

JPSU

TCK

JPCO

JPZX

JPXZ

TDO

PLL Specifications

Diagram of PLL Specifications

CLKOUT Pins

f_{OUT_EXT}

Switchover

f_IN

CLK

f_INPFD

GCLK

RCLK

Counters

C 0..C 17

f_VCO

VCO

f_OUT

PFD

Core Clock

Delta Sigma

Modulator

Key

External Feedback

Reconfigurable in User Mode

Note:

1. Core Clock can only be fed by dedicated clock input pins or PLL outputs.

R_L

Receiver differential input discrete resistor (external to the Arria V GZ device).

Arria V GZ Device Datasheet

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