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5962-9555001NXDX

更新时间： 2024-02-17 13:25:02
品牌 Logo 应用领域
德州仪器 - TI 比较器放大器放大器电路
页数 文件大小 规格书
30页 991K
描述
COMPARATOR, 10000uV OFFSET-MAX, PDSO14, PLASTIC, SOP-14

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5962-9555001NXDX 技术参数

生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP,针数：14
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.63
放大器类型：COMPARATOR最大平均偏置电流 (IIB)：0.03 µA
最大输入失调电压：10000 µVJESD-30 代码：R-PDSO-G14
JESD-609代码：e4长度：8.65 mm
负供电电压上限：-18 V功能数量：1
端子数量：14最高工作温度：125 °C
最低工作温度：-55 °C封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE认证状态：Not Qualified
筛选级别：MIL-PRF-38535 Class N座面最大高度：1.75 mm
供电电压上限：18 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：PALLADIUM
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL宽度：3.9 mm
Base Number Matches：1

5962-9555001NXDX 数据手册

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switching characteristics, V  
= 5 V, T = 25°C (see Figure 3)  
A
DD  
TLC139M, TLC339C  
TLC339I, TLC339M  
TLC339Q  
PARAMETER  
TEST CONDITIONS  
UNIT  
MIN  
TYP  
4.5  
MAX  
Overdrive = 2 mV  
Overdrive = 5 mV  
2.5  
f = 10 kHz,  
= 15 pF  
Overdrive = 10 mV  
Overdrive = 20 mV  
Overdrive = 40 mV  
1.7  
C
L
t
Propagation delay time, low-to-high output  
µs  
PLH  
1.2  
1.0  
V = 1.4 V step at IN+  
I
1.1  
Overdrive = 2 mV  
3.6  
Overdrive = 5 mV  
Overdrive = 10 mV  
Overdrive = 20 mV  
Overdrive = 40 mV  
2.1  
f = 10 kHz,  
= 15 pF  
1.3  
C
L
t
t
Propagation delay time, high-to-low level output  
Transition time, high-to-low level output  
µs  
PHL  
0.85  
0.55  
0.10  
V = 1.4 V step at IN+  
I
f = 10 kHz,  
Overdrive = 50 mV  
20  
ns  
THL  
C
= 15pF  
L
PARAMETER MEASUREMENT INFORMATION  
The TLC139 and TLC339 contain a digital output stage that, if held in the linear region of the transfer curve, can cause  
damage to the device. Conventional operational amplifier/comparator testing incorporates the use of a servo-loop  
that is designed to force the device output to a level within this linear region. Since the servo-loop method of testing  
cannot be used, the following alternatives for testing parameters such as input offset voltage, common-mode  
rejection, etc., are suggested.  
To verify that the input offset voltage falls within the limits specified, the limit value is applied to the input as shown  
in Figure 1(a). With the noninverting input positive with respect to the inverting input, the output should be high. With  
the input polarity reversed, the output should be low.  
A similar test can be made to verify the input offset voltage at the common-mode extremes. The supply voltages can  
be slewed as shown in Figure 1(b) for the V  
accuracy.  
test, rather than changing the input voltages, to provide greater  
ICR  
5 V  
1 V  
5.1 kΩ  
5.1 kΩ  
Applied V  
IO  
Applied V  
Limit  
IO  
Limit  
V
O
V
O
− 4 V  
(a) V WITH V = 0 V  
IO IC  
(b) V WITH V = 4 V  
IO IC  
Figure 1. Method for Verifying That Input Offset Voltage Is Within Specified Limits  
7
WWW.TI.COM  
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